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  1. 研究報告
  2. システム・アーキテクチャ(ARC)
  3. 2009
  4. 1(2009-ARC-181)

メディアアプリケーションを用いた並列化コンパイラ協調型へテロジニアスマルチコアアーキテクチャのシミュレーション評価

https://ipsj.ixsq.nii.ac.jp/records/61056
https://ipsj.ixsq.nii.ac.jp/records/61056
3db3d1eb-b319-45ec-bef3-972bd5657375
名前 / ファイル ライセンス アクション
IPSJ-ARC09181012.pdf IPSJ-ARC09181012 (1.0 MB)
Copyright (c) 2009 by the Information Processing Society of Japan
オープンアクセス
Item type SIG Technical Reports(1)
公開日 2009-01-06
タイトル
タイトル メディアアプリケーションを用いた並列化コンパイラ協調型へテロジニアスマルチコアアーキテクチャのシミュレーション評価
タイトル
言語 en
タイトル Performance Evaluation of Parallelizing Compiler Cooperated Heterogeneous Multicore Architecture Using Media Applications
言語
言語 jpn
資源タイプ
資源タイプ識別子 http://purl.org/coar/resource_type/c_18gh
資源タイプ technical report
著者所属
早稲田大学理工学術院基幹理工学部情報理工学科
著者所属
早稲田大学理工学術院基幹理工学部情報理工学科
著者所属
早稲田大学理工学術院基幹理工学部情報理工学科
著者所属
早稲田大学理工学術院基幹理工学部情報理工学科
著者所属
早稲田大学理工学術院基幹理工学部情報理工学科
著者所属
早稲田大学理工学術院基幹理工学部情報理工学科
著者所属
早稲田大学理工学術院基幹理工学部情報理工学科
著者所属
早稲田大学理工学術院基幹理工学部情報理工学科
著者所属(英)
en
Department of Computer Science and Engineering, Waseda University
著者所属(英)
en
Department of Computer Science and Engineering, Waseda University
著者所属(英)
en
Department of Computer Science and Engineering, Waseda University
著者所属(英)
en
Department of Computer Science and Engineering, Waseda University
著者所属(英)
en
Department of Computer Science and Engineering, Waseda University
著者所属(英)
en
Department of Computer Science and Engineering, Waseda University
著者所属(英)
en
Department of Computer Science and Engineering, Waseda University
著者所属(英)
en
Department of Computer Science and Engineering, Waseda University
著者名 神山, 輝壮 和田, 康孝 林, 明宏 間瀬, 正啓 中野, 啓史 渡辺, 岳志 木村, 啓二 笠原, 博徳

× 神山, 輝壮 和田, 康孝 林, 明宏 間瀬, 正啓 中野, 啓史 渡辺, 岳志 木村, 啓二 笠原, 博徳

神山, 輝壮
和田, 康孝
林, 明宏
間瀬, 正啓
中野, 啓史
渡辺, 岳志
木村, 啓二
笠原, 博徳

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著者名(英) Teruo, Kamiyama Yasutaka, Wada Akihiro, Hayashi Masayoshi, Mase Hirohumi, Nakano Takeshi, Watanabe Keiji, Kimura Hironori, Kasahara

× Teruo, Kamiyama Yasutaka, Wada Akihiro, Hayashi Masayoshi, Mase Hirohumi, Nakano Takeshi, Watanabe Keiji, Kimura Hironori, Kasahara

en Teruo, Kamiyama
Yasutaka, Wada
Akihiro, Hayashi
Masayoshi, Mase
Hirohumi, Nakano
Takeshi, Watanabe
Keiji, Kimura
Hironori, Kasahara

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論文抄録
内容記述タイプ Other
内容記述 本稿では,汎用プロセッサコアに加え複数のアクセラレータを 1 チップ上に集積したヘテロジニアスマルチコアアーキテクチャと,それに協調する自動並列化コンパイラの性能について述べる.コンパイラによる並列性の抽出を考慮して記述されたマルチメディアアプリケーションを用いて,汎用 CPU コアを 2 基, FE-GA を想定したアクセラレータコアを 2 基搭載したヘテロジニアスマルチコアアーキテクチヤ構成で評価したところ, MP3 エンコーダでは 1 つの汎用 CPU コアに対して 9.82 倍, JPEG 2000 エンコーダでは 14.64 倍 の速度向上率が得られた.
論文抄録(英)
内容記述タイプ Other
内容記述 This paper describes a heterogeneous multicore architecture having accelerator cores in addition to general purpose cores, an automatic parallelizing compiler that cooperatively works with the heterogeneous multicore, a heterogeneous multicore architecture simulation environment, and performance evaluation results with the simulation environment. For the performance evaluation, multimedia applications written in C or Fortran, considered with parallelization by the compiler, are used. As a result, the evaluated heterogeneous multicore having two general purpose cores and two accelerator cores achieves 9.82 times speedup from MP3 encoder. This architecture also achieves 14.64 times speedup from JPEG2000 encoder.
書誌レコードID
収録物識別子タイプ NCID
収録物識別子 AN10096105
書誌情報 研究報告計算機アーキテクチャ(ARC)

巻 2009, 号 1(2009-ARC-181), p. 63-68, 発行日 2009-01-06
Notice
SIG Technical Reports are nonrefereed and hence may later appear in any journals, conferences, symposia, etc.
出版者
言語 ja
出版者 情報処理学会
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Ver.1 2025-01-21 22:16:52.632602
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