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  1. 研究報告
  2. システムとLSIの設計技術(SLDM)
  3. 2008
  4. 111(2008-SLDM-137)

高信頼セルによる回路の信頼性評価

https://ipsj.ixsq.nii.ac.jp/records/26753
https://ipsj.ixsq.nii.ac.jp/records/26753
79fcfda3-6b2a-4c3c-851a-33135a760f2a
名前 / ファイル ライセンス アクション
IPSJ-SLDM08137016.pdf IPSJ-SLDM08137016.pdf (804.8 kB)
Copyright (c) 2008 by the Information Processing Society of Japan
オープンアクセス
Item type SIG Technical Reports(1)
公開日 2008-11-10
タイトル
タイトル 高信頼セルによる回路の信頼性評価
タイトル
言語 en
タイトル Evaluating the reliability of Highly Reliable Cell Circuits
言語
言語 jpn
資源タイプ
資源タイプ識別子 http://purl.org/coar/resource_type/c_18gh
資源タイプ technical report
著者所属
奈良先端科学技術大学院大学
著者所属
奈良先端科学技術大学院大学
著者所属
奈良先端科学技術大学院大学
著者所属
奈良先端科学技術大学院大学
著者所属
奈良先端科学技術大学院大学
著者所属(英)
en
Nara Institute of Science and Technology
著者所属(英)
en
Nara Institute of Science and Technology
著者所属(英)
en
Nara Institute of Science and Technology
著者所属(英)
en
Nara Institute of Science and Technology
著者所属(英)
en
Nara Institute of Science and Technology
著者名 堀田, 敬一 中田, 尚 中西, 正樹 山下, 茂 中島, 康彦

× 堀田, 敬一 中田, 尚 中西, 正樹 山下, 茂 中島, 康彦

堀田, 敬一
中田, 尚
中西, 正樹
山下, 茂
中島, 康彦

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著者名(英) Keiichi, Hotta Takashi, Nakada Masaki, Nakanishi Shigeru, Yamashita Yasuhiko, Nakashima

× Keiichi, Hotta Takashi, Nakada Masaki, Nakanishi Shigeru, Yamashita Yasuhiko, Nakashima

en Keiichi, Hotta
Takashi, Nakada
Masaki, Nakanishi
Shigeru, Yamashita
Yasuhiko, Nakashima

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論文抄録
内容記述タイプ Other
内容記述 近年のトランジスタ製造によるプロセス微細化によって,トランジスタの故障率の増加が問題となっている.そこで故障率の増加を抑える手法として,高信頼セルを用いて回路を構成する手法が提案されている.高信頼セルは従来セルと比較して耐故障性が高いと考えられている.この耐故障性を定量的に扱うためには,信頼性評価を行う必要がある.信頼性評価手法はいくつか提案されているが,従来手法を用いて高信頼セルの信頼性評価を行う場合,信頼性を正確に評価できない問題が生じる.そこで本論文では,正確な評価を行うためにトランジスタの故障率をもとに回路全体の信頼性を評価する手法を提案する.これにより従来セルと高信頼セルによる回路の信頼性を定量的に評価することが可能になる.提案手法を用いた従来セルと高信頼セルの信頼性の評価実験を行った結果,従来セルと比較して高信頼セルの信頼性がどの程度高いかを定量的に示した.
論文抄録(英)
内容記述タイプ Other
内容記述 Recently, the shrinking process causes transistor variation and growth of error rate. Highly Reliable Cells (HRCs) have been proposed to solve these problems. We need to evaluate reliability of them quantitatively, because they are considered to be highly reliable. Although, there have been proposed several methods to evaluate the reliability, they cannot evaluate the reliability of circuits by HRCs accurately. Therefore, in this paper, we propose a new evaluation method for the reliability of circuits based on the fault probability of each transistor. The method can evaluate the reliablity of circuits by HRCs or the CMOS cells. The experimental results show that HRCs are more reliable than the CMOS cells.
書誌レコードID
収録物識別子タイプ NCID
収録物識別子 AA11451459
書誌情報 情報処理学会研究報告システムLSI設計技術(SLDM)

巻 2008, 号 111(2008-SLDM-137), p. 91-96, 発行日 2008-11-10
Notice
SIG Technical Reports are nonrefereed and hence may later appear in any journals, conferences, symposia, etc.
出版者
言語 ja
出版者 情報処理学会
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Ver.1 2025-01-22 18:52:34.435650
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