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  1. 研究報告
  2. システム・アーキテクチャ(ARC)
  3. 2022
  4. 2022-ARC-248

高帯域幅メモリ搭載FPGAを用いたランダムアクセス指向メモリアーキテクチャとプログラミングモデルの検討

https://ipsj.ixsq.nii.ac.jp/records/217132
https://ipsj.ixsq.nii.ac.jp/records/217132
cf2468f7-c7e0-4d28-ba07-ae03836336d8
名前 / ファイル ライセンス アクション
IPSJ-ARC22248044.pdf IPSJ-ARC22248044.pdf (861.7 kB)
Copyright (c) 2022 by the Information Processing Society of Japan
オープンアクセス
Item type SIG Technical Reports(1)
公開日 2022-03-03
タイトル
タイトル 高帯域幅メモリ搭載FPGAを用いたランダムアクセス指向メモリアーキテクチャとプログラミングモデルの検討
言語
言語 jpn
キーワード
主題Scheme Other
主題 メモリ・アーキテクチャ
資源タイプ
資源タイプ識別子 http://purl.org/coar/resource_type/c_18gh
資源タイプ technical report
著者所属
東京大学
著者所属
東京大学
著者名 菅, 研吾

× 菅, 研吾

菅, 研吾

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高前田(山崎), 伸也

× 高前田(山崎), 伸也

高前田(山崎), 伸也

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論文抄録
内容記述タイプ Other
内容記述 High Bandwidth Memory (HBM) は最近の多くの FPGA ボードで利用可能である.HBM はそのバス幅の広さによって,メモリアクセスの観点からアプリケーションの高速化を図ることが可能である.しかしながら HBM が複数の擬似チャネルを持つ構造や,各チャネルの比較的長いレイテンシのため,HBM から理想的な性能を引き出すのが難しいことが知られている.本稿では,ランダムメモリアクセス待ち時間とスループットが性能に関わる FPGA ベースのアクセラレータ上で,HBM 固有の広いバス幅を利用した高性能汎用メモリアーキテクチャとプログラミングモデルを提案する.プログラミングモデルはロードリクエスト,レイテンシの待機,データ読み込みを異なる命令に分割し,この命令の分離は計算時間を利用したデータ移動時間の隠蔽を容易にする.データは読み込み要求時に発行されたタグに基づき管理が行われる.シミュレーションに基づく初期評価により,提案するメモリシステムが低い導入コストでグラフ処理を 3.7-7.6 倍高速化することを示した.
書誌レコードID
収録物識別子タイプ NCID
収録物識別子 AN10096105
書誌情報 研究報告システム・アーキテクチャ(ARC)

巻 2022-ARC-248, 号 44, p. 1-5, 発行日 2022-03-03
ISSN
収録物識別子タイプ ISSN
収録物識別子 2188-8574
Notice
SIG Technical Reports are nonrefereed and hence may later appear in any journals, conferences, symposia, etc.
出版者
言語 ja
出版者 情報処理学会
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Ver.1 2025-01-19 15:36:41.059078
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