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  1. 研究報告
  2. システム・アーキテクチャ(ARC)
  3. 2025
  4. 2025-ARC-261

FPGAアクセラレータ向けホスト-デバイス間通信自動最適化ツールの提案

https://ipsj.ixsq.nii.ac.jp/records/2002258
https://ipsj.ixsq.nii.ac.jp/records/2002258
14d75267-3a67-443b-b570-0f545b35ea49
名前 / ファイル ライセンス アクション
IPSJ-ARC25261022.pdf IPSJ-ARC25261022.pdf (440.8 KB)
 2027年6月2日からダウンロード可能です。
Copyright (c) 2025 by the Information Processing Society of Japan
非会員:¥660, IPSJ:学会員:¥330, ARC:会員:¥0, DLIB:会員:¥0
Item type SIG Technical Reports(1)
公開日 2025-06-02
タイトル
言語 ja
タイトル FPGAアクセラレータ向けホスト-デバイス間通信自動最適化ツールの提案
言語
言語 jpn
キーワード
主題Scheme Other
主題 実践的FPGA
資源タイプ
資源タイプ識別子 http://purl.org/coar/resource_type/c_18gh
資源タイプ technical report
著者所属
名古屋工業大学
著者所属
名古屋工業大学
著者所属
名古屋工業大学
著者所属(英)
en
Nagoya Institute of Technology
著者所属(英)
en
Nagoya Institute of Technology
著者所属(英)
en
Nagoya Institute of Technology
著者名 西田,宗馬

× 西田,宗馬

西田,宗馬

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小泉,透

× 小泉,透

小泉,透

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津邑,公暁

× 津邑,公暁

津邑,公暁

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論文抄録
内容記述タイプ Other
内容記述 高位合成(HLS)は特定アプリケーションのためのFPGA回路を迅速かつ容易に設計することを可能にした.しかし,HLSプログラミングには対象となるハードウェアに関する知識が必要となるため,依然としてソフトウェアプログラマにとって利用の難易度が高い.この課題を解決するため,HLSプログラム作成を自動化・抽象化するツールが研究されている.従来のツールはpragmaの自動挿入やループ変形による自動並列化などを行うが,近年のFPGAアクセラレータに搭載される複数の外部メモリの活用については考慮されていない.そのため,HLSプログラミングにおいて,ユーザーはメモリの物理的構造を意識したデータ転送の最適化を行う必要がある.そこで本稿では,複数の外部メモリが搭載されたFPGAアクセラレータを対象に,HLSプログラムのホスト-デバイス間データ転送を自動最適化するツールを提案する.提案ツールは複数の外部メモリにホストから転送されるデータを分散配置し,カーネルプログラムを分割実行することでデータ転送時間のオーバーラップを実現する.提案ツールによる最適化をベンチマークプログラムに適用して評価を行った結果,カーネル実行時間を平均18%削減し,なおかつ回路規模の増加は最大でも1.1%と微小におさまることを確認した.
書誌レコードID
収録物識別子タイプ NCID
収録物識別子 AN10096105
書誌情報 研究報告システム・アーキテクチャ(ARC)

巻 2025-ARC-261, 号 22, p. 1-7, 発行日 2025-06-02
ISSN
収録物識別子タイプ ISSN
収録物識別子 2188-8574
Notice
SIG Technical Reports are nonrefereed and hence may later appear in any journals, conferences, symposia, etc.
出版者
言語 ja
出版者 情報処理学会
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Ver.1 2025-05-26 04:57:37.821607
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