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論理回路図簡略記法に関する考察
https://ipsj.ixsq.nii.ac.jp/records/116758
https://ipsj.ixsq.nii.ac.jp/records/116758a0fbc997-baf1-4053-a09f-54667c9c22dc
| 名前 / ファイル | ライセンス | アクション |
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KJ00003117915.pdf (124.3 kB)
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| Item type | National Convention(1) | |||||
|---|---|---|---|---|---|---|
| 公開日 | 1989-03-15 | |||||
| タイトル | ||||||
| タイトル | 論理回路図簡略記法に関する考察 | |||||
| タイトル | ||||||
| 言語 | en | |||||
| タイトル | Some notations of function logic diagram | |||||
| 言語 | ||||||
| 言語 | jpn | |||||
| 資源タイプ | ||||||
| 資源タイプ識別子 | http://purl.org/coar/resource_type/c_5794 | |||||
| 資源タイプ | conference paper | |||||
| 著者所属 | ||||||
| (株)日立製作所 | ||||||
| 著者所属 | ||||||
| (株)日立製作所 | ||||||
| 著者所属 | ||||||
| (株)日立製作所 | ||||||
| 著者所属(英) | ||||||
| en | ||||||
| HITACHI, Ltd. | ||||||
| 著者所属(英) | ||||||
| en | ||||||
| HITACHI, Ltd. | ||||||
| 著者所属(英) | ||||||
| en | ||||||
| HITACHI, Ltd. | ||||||
| 論文抄録 | ||||||
| 内容記述タイプ | Other | |||||
| 内容記述 | 従来のゲートレベル論理回路図はAND,ORゲートなどの論理シンボルを用いて記述していた。このため、設計規模の拡大に伴い論理回路図枚数も増加し、論理設計、論理検証などの設計効率低下の原因になっていた。そこで、論理回路図の読み易さを損なうことなく、設計情報を簡略表現できる図面密度向上手法を考案した。以下では、ゲートレベル論理回路図の上位階層図面に位置付ける機能レベル論理図記法について述べる。 | |||||
| 書誌レコードID | ||||||
| 収録物識別子タイプ | NCID | |||||
| 収録物識別子 | AN00349328 | |||||
| 書誌情報 |
全国大会講演論文集 巻 第38回, 号 ハードウェア, p. 1355-1356, 発行日 1989-03-15 |
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| 出版者 | ||||||
| 言語 | ja | |||||
| 出版者 | 情報処理学会 | |||||
