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  1. 研究報告
  2. システム・アーキテクチャ(ARC)
  3. 2012
  4. 2012-ARC-198

アイドル時のキャッシュ電源遮断による性能ペナルティとその削減手法

https://ipsj.ixsq.nii.ac.jp/records/80001
https://ipsj.ixsq.nii.ac.jp/records/80001
da03aa9d-d309-4516-9a99-33e4f8ee85ad
名前 / ファイル ライセンス アクション
IPSJ-ARC12198002.pdf IPSJ-ARC12198002.pdf (968.8 kB)
Copyright (c) 2012 by the Information Processing Society of Japan
オープンアクセス
Item type SIG Technical Reports(1)
公開日 2012-01-12
タイトル
タイトル アイドル時のキャッシュ電源遮断による性能ペナルティとその削減手法
言語
言語 jpn
キーワード
主題Scheme Other
主題 低消費電力技術
資源タイプ
資源タイプ識別子 http://purl.org/coar/resource_type/c_18gh
資源タイプ technical report
著者所属
東京大学
著者所属
東京大学
著者所属
東京大学
著者所属
東京大学
著者所属(英)
en
The University of Tokyo
著者所属(英)
en
The University of Tokyo
著者所属(英)
en
The University of Tokyo
著者所属(英)
en
The University of Tokyo
著者名 有間英志 薦田登志矢 三輪忍 中村宏

× 有間英志 薦田登志矢 三輪忍 中村宏

有間英志
薦田登志矢
三輪忍
中村宏

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論文抄録
内容記述タイプ Other
内容記述 プロセッサがアイドル時に消費するリーク電力が全消費電力に占める割合は,トランジスタの微細化が進むにつれて年々上昇を続け問題となっている.このようなリーク電力を削減する目的で,プロセッサアイドル時にコアへの電源供給を遮断するパワーゲーティング技術がモバイル向け・デスクトップ向けのプロセッサで広く用いられている.現行のシステムでは,CPU のアイドル時間が一定の閾値を越えた場合にコアへの電源遮断を制御しているが,このとき問題になるのがスリープモード中にキャッシュに存在するデータが揮発することによって生じるスリープ復帰後のキャッシュミスの増大である.本研究ではコアがスリープモードに入った場合に生じるキャッシュフラッシュの影響によるキャッシュミス増大を回避するための,キャッシュプリフェッチ手法を提案しその効果について予備的な評価を行う.
書誌レコードID
収録物識別子タイプ NCID
収録物識別子 AN10096105
書誌情報 研究報告計算機アーキテクチャ(ARC)

巻 2012-ARC-198, 号 2, p. 1-6, 発行日 2012-01-12
Notice
SIG Technical Reports are nonrefereed and hence may later appear in any journals, conferences, symposia, etc.
出版者
言語 ja
出版者 情報処理学会
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Ver.1 2025-01-21 20:00:03.005538
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