| Item type |
Symposium(1) |
| 公開日 |
2023-08-23 |
| タイトル |
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タイトル |
ダブルビア制約付きコモンセントロイド配置におけるペア対称配線手法 |
| タイトル |
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言語 |
en |
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タイトル |
Pair Symmetrical Routing in Common Centroid Placement with Double Via Constraints |
| 言語 |
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言語 |
jpn |
| キーワード |
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主題Scheme |
Other |
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主題 |
アナログ回路設計，ポスター |
| 資源タイプ |
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資源タイプ識別子 |
http://purl.org/coar/resource_type/c_5794 |
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資源タイプ |
conference paper |
| 著者所属 |
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東京工業大学 |
| 著者所属 |
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東京工業大学 |
| 著者所属 |
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東京工業大学 |
| 著者所属 |
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(株)ジーダット |
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(株)ジーダット |
| 著者所属 |
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(株)ジーダット |
| 著者所属(英) |
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en |
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Tokyo Institute of Technology |
| 著者所属(英) |
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en |
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Tokyo Institute of Technology |
| 著者所属(英) |
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en |
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Tokyo Institute of Technology |
| 著者所属(英) |
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en |
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JEDAT |
| 著者所属(英) |
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en |
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JEDAT |
| 著者所属(英) |
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en |
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JEDAT |
| 著者名 |
徐, 紫昂
田湯, 智
高橋, 篤司
モロンゴ, マチュー
南, 誠
西岡, 克也
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| 著者名(英) |
Zuan, Jo
Satoshi, Tayu
Atsushi, Takahasi
Mathieu, Molong
Makoto, Minami
Katsuya, Nishioka
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| 論文抄録 |
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内容記述タイプ |
Other |
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内容記述 |
アナログ集積回路では，素子特性の相対精度を頼りとした設計が一般に行われる．本研究は，コモンセントロイド配置されているトランジスタを対象に，対称的な配線を生成する手法の実現を目的とする．2 層ペア対称配線において，ネット数に対して利用できる縦トラックの割合が少ない場合には，隣接端子の配線が縦トラックを共有する必要がある．我々は配線テンプレートを利用して，ペア対称配線を効率よく生成する配線手法を提案したが，配線の層間接続にはシングルビアを用いていた．本稿では，配線の信頼性を向上させるために，層間接続にダブルビアを用いる場合に用いることができるペア対称配線手法を提案する． |
| 論文抄録(英) |
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内容記述タイプ |
Other |
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内容記述 |
In analog integrated circuits, designs generally rely on the relative accuracy of device characteristics. The objective of this study is to realize a method to generate symmetric interconnections for transistors in a common centroid arrangement. 2-layer pair symmetric interconnections require adjacent terminal interconnections to share vertical tracks when the ratio of available vertical tracks to the number of nets is small. We have proposed a routing method that uses a routing template to avoid constraint violations, but single vias are used for interlayer connections. In this paper, we propose an interconnect method that uses double vias for interlayer connections to improve interconnect reliability. |
| 書誌情報 |
DAシンポジウム2023論文集
巻 2023,
p. 207-212,
発行日 2023-08-23
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| 出版者 |
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言語 |
ja |
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出版者 |
情報処理学会 |
IPSJ-DAS2023033.pdf (2.3 MB)
