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アイテム
FPGA向け4倍精度浮動小数点演算器の設計と共役勾配法による評価
https://ipsj.ixsq.nii.ac.jp/records/216114
https://ipsj.ixsq.nii.ac.jp/records/21611499887140-8271-4021-b953-a81dfca15ec9
名前 / ファイル | ライセンス | アクション |
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Copyright (c) 2022 by the Institute of Electronics, Information and Communication Engineers This SIG report is only available to those in membership of the SIG.
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ARC:会員:¥0, DLIB:会員:¥0 |
Item type | SIG Technical Reports(1) | |||||||||||
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公開日 | 2022-01-17 | |||||||||||
タイトル | ||||||||||||
タイトル | FPGA向け4倍精度浮動小数点演算器の設計と共役勾配法による評価 | |||||||||||
タイトル | ||||||||||||
言語 | en | |||||||||||
タイトル | Design of a Quadruple Precision Floating-Point Arithmetic Unit and its Evaluation by Conjugate Gradient Method | |||||||||||
言語 | ||||||||||||
言語 | jpn | |||||||||||
キーワード | ||||||||||||
主題Scheme | Other | |||||||||||
主題 | HPC | |||||||||||
資源タイプ | ||||||||||||
資源タイプ識別子 | http://purl.org/coar/resource_type/c_18gh | |||||||||||
資源タイプ | technical report | |||||||||||
著者名 |
柿根, 尚喜
× 柿根, 尚喜
× 窪田, 昌史
× 弘中, 哲夫
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著者名(英) |
Naoki, Kakine
× Naoki, Kakine
× Atsushi, Kubota
× Tetsuo, Hironaka
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論文抄録 | ||||||||||||
内容記述タイプ | Other | |||||||||||
内容記述 | 4 倍精度浮動小数点演算の需要は多いものの,商用プロセッサへの搭載例は少なく,ソフトウェアによる低速なエミュレーションで実現されていることが問題となっている.そこで我々は FPGA による高速化に着目した.4 倍精度浮動小数点演算器およびそれを呼び出す共役勾配法を C++ 言語で記述し,高位合成を利用して Xilinx 社 FPGA である Alveo U50 向けに実装したところ,行列サイズ 494 × 494 で汎用 CPU より高速に実行できることを確認した. | |||||||||||
書誌レコードID | ||||||||||||
収録物識別子タイプ | NCID | |||||||||||
収録物識別子 | AN10096105 | |||||||||||
書誌情報 |
研究報告システム・アーキテクチャ(ARC) 巻 2022-ARC-247, 号 27, p. 1-5, 発行日 2022-01-17 |
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ISSN | ||||||||||||
収録物識別子タイプ | ISSN | |||||||||||
収録物識別子 | 2188-8574 | |||||||||||
Notice | ||||||||||||
SIG Technical Reports are nonrefereed and hence may later appear in any journals, conferences, symposia, etc. | ||||||||||||
出版者 | ||||||||||||
言語 | ja | |||||||||||
出版者 | 情報処理学会 |