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  1. 研究報告
  2. システム・アーキテクチャ(ARC)
  3. 2016
  4. 2016-ARC-221

電力制約型FPGAアクセラレータにおける実行制御手法の検討

https://ipsj.ixsq.nii.ac.jp/records/172936
https://ipsj.ixsq.nii.ac.jp/records/172936
bd6580f5-2add-42c3-8096-20279c84530a
名前 / ファイル ライセンス アクション
IPSJ-ARC16221040.pdf IPSJ-ARC16221040.pdf (443.2 kB)
Copyright (c) 2016 by the Institute of Electronics, Information and Communication Engineers This SIG report is only available to those in membership of the SIG.
ARC:会員:¥0, DLIB:会員:¥0
Item type SIG Technical Reports(1)
公開日 2016-08-01
タイトル
タイトル 電力制約型FPGAアクセラレータにおける実行制御手法の検討
言語
言語 jpn
キーワード
主題Scheme Other
主題 FPGA・シミュレーション
資源タイプ
資源タイプ識別子 http://purl.org/coar/resource_type/c_18gh
資源タイプ technical report
著者所属
奈良先端科学技術大学院大学情報科学研究科
著者所属
奈良先端科学技術大学院大学情報科学研究科
著者所属
奈良先端科学技術大学院大学情報科学研究科
著者名 藤本, 啓輔

× 藤本, 啓輔

藤本, 啓輔

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高前田, 伸也

× 高前田, 伸也

高前田, 伸也

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中島, 康彦

× 中島, 康彦

中島, 康彦

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論文抄録
内容記述タイプ Other
内容記述 スーパーコンピュータなど大規模システムの規模・処理量の増大により消費電力が増加している.しかし,利用可能な電力資源量によりシステム全体の性能は制約されるため,電力制約下での性能最大化が重要になっている.そのため,CPU,GPU,FPGA といった計算資源に対する効率の良い電力配分が必要となる.CPU では周波数を下げるなどすることで全体の消費電力を制約する方法がある.一方,FPGA の場合,動的に周波数を変更できるデバイスは一部だけであるため,周波数以外の電力制御手法が必要である.本研究では,電力制約型 FPGA アクセラレータの動的電力制御を可能にするために,オンチップバスインターフェースを利用した実行制御手法を提案する.本論文では,FPGA の動的電力制御を可能にする軽量なバスインターフェース方式と,目標電力に応じた電力制御モデルを提案する.そして,周波数を変更し電力制御を行う静的回路を比較対象とし,消費電力およびシステム性能と電力の線形性の比較を行う.積和演算とステンシル演算という 2 種類のアプリケーションを用いて評価を行った.評価の結果,提案手法は,目標電力とシステム性能の高い線形性を持ち,周波数変動方式と比較しても,軽量な回路にも関わらず同等の精度で制御できることが明らかになった.特に,制御間隔が大きいほど線形性が向上することが明かになった.
書誌レコードID
収録物識別子タイプ NCID
収録物識別子 AN10096105
書誌情報 研究報告システム・アーキテクチャ(ARC)

巻 2016-ARC-221, 号 40, p. 1-6, 発行日 2016-08-01
ISSN
収録物識別子タイプ ISSN
収録物識別子 2188-8574
Notice
SIG Technical Reports are nonrefereed and hence may later appear in any journals, conferences, symposia, etc.
出版者
言語 ja
出版者 情報処理学会
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Ver.1 2025-01-20 07:33:18.739326
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