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  1. 全国大会
  2. 75回
  3. アーキテクチャ

Design of Synchronization Mechanism to Conquer the Clock Oscillator Variation for High Performance Stencil Computation Accelerator

https://ipsj.ixsq.nii.ac.jp/records/110893
https://ipsj.ixsq.nii.ac.jp/records/110893
2f83ab94-df39-487d-a117-23185b68e08d
名前 / ファイル ライセンス アクション
IPSJ-Z75-3K-7.pdf IPSJ-Z75-3K-7.pdf (939.0 kB)
Copyright (c) 2013 by the Information Processing Society of Japan
オープンアクセス
Item type National Convention(1)
公開日 2013-03-06
タイトル
タイトル Design of Synchronization Mechanism to Conquer the Clock Oscillator Variation for High Performance Stencil Computation Accelerator
言語
言語 eng
キーワード
主題Scheme Other
主題 アーキテクチャ
資源タイプ
資源タイプ識別子 http://purl.org/coar/resource_type/c_5794
資源タイプ conference paper
著者所属
東工大
著者所属
東工大
著者所属
東工大
著者名 小林諒平

× 小林諒平

小林諒平

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高前田ー山崎伸也

× 高前田ー山崎伸也

高前田ー山崎伸也

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吉瀬謙二

× 吉瀬謙二

吉瀬謙二

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論文抄録
内容記述タイプ Other
内容記述 Stencil computation is one of the typical scientific computing kernels. It is applied diverse areas as Earthquake simulation, seismic imaging for the oil and gas exploration industry. We have proposed the effective stencil computation method and the architecture by employing multiple small FPGAs with 2Dmech topology. However, as we implemented stencil computation accelerator, we realized that the accelerator does not stable operate because clock oscillator variation occurs. This variation occurs because each FPGA node which composes the accelerator has unique clock domain. In this paper, we evaluate clock oscillator variation quantitatively and describe design of synchronization mechanism to conquer the variation to operate the accelerator successfully.
書誌レコードID
収録物識別子タイプ NCID
収録物識別子 AN00349328
書誌情報 第75回全国大会講演論文集

巻 2013, 号 1, p. 133-134, 発行日 2013-03-06
出版者
言語 ja
出版者 情報処理学会
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Ver.1 2025-01-21 07:37:33.392201
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