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  1. 研究報告
  2. システムとLSIの設計技術(SLDM)
  3. 2009
  4. 22(2009-SLDM-139)

Non-uniform Selective Way Cache の動的制御による組込みプロセッサの省エネルギー化

https://ipsj.ixsq.nii.ac.jp/records/62013
https://ipsj.ixsq.nii.ac.jp/records/62013
b0e90079-be8e-4280-bca5-bbdff6633571
名前 / ファイル ライセンス アクション
IPSJ-SLDM09139003.pdf IPSJ-SLDM09139003 (862.6 kB)
Copyright (c) 2009 by the Information Processing Society of Japan
オープンアクセス
Item type SIG Technical Reports(1)
公開日 2009-02-26
タイトル
タイトル Non-uniform Selective Way Cache の動的制御による組込みプロセッサの省エネルギー化
タイトル
言語 en
タイトル A Dynamic Management Technique of a Non-uniform Selective Way Cache for Reducing the Energy Consumption of Embedded Processors
言語
言語 jpn
資源タイプ
資源タイプ識別子 http://purl.org/coar/resource_type/c_18gh
資源タイプ technical report
著者所属
九州大学大学院システム情報科学府
著者所属
九州大学システムLSI 研究センター
著者所属
九州大学
著者所属(英)
en
Graduate School of Information Science and Electrical Engineering, Kyushu University
著者所属(英)
en
System LSI Research Center, Kyushu University
著者所属(英)
en
Kyushu University
著者名 石飛, 百合子 石原, 亨 安浦, 寛人

× 石飛, 百合子 石原, 亨 安浦, 寛人

石飛, 百合子
石原, 亨
安浦, 寛人

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著者名(英) Yuriko, Ishitobi Tohru, Ishihara Hiroto, Yasuura

× Yuriko, Ishitobi Tohru, Ishihara Hiroto, Yasuura

en Yuriko, Ishitobi
Tohru, Ishihara
Hiroto, Yasuura

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論文抄録
内容記述タイプ Other
内容記述 本稿は Non-uniform Selective Way Cache (NSWC) の動的ウェイ切り替えによる組込みプロセッサの省エネルギー化手法の提案を行う. NSWC は,消費エネルギーの観点で異なる性質の 2 種類のウェイを保持する.提案手法は命令キャッシュとして NSWC を用い,アプリケーションプログラムへのウェイ切り替え命令を挿入することで, 動的なウェイ切り替えを行う.動的ウェイ切り替えを行うことで,キャッシュメモリのアクセスエネルギーの削減と高いキャッシュヒット率を両立し,組込みプロセッサの省エネルギー化を実現する.提案手法を用いることで,セット・アソシアティブ方式のキャッシュメモリを利用した場合と比較して 7% ~ 20% の消費エネルギー削減効果を確認した.
論文抄録(英)
内容記述タイプ Other
内容記述 This paper proposes a dynamic management technique of Non-uniform Selective Way Cache(NSWC) for reducing the total energy consumption of a CPU core, cache memories, and off-chip memories. NSWC has a way uses low supply (Vdd) and low threshould (Vth). In our approach, we decide insert points of instructions to change available ways in the Non-uniform Selective Way Cache. Experiments using parameters of a commercial embedded processor and an off-chip SDRAM demonstrate that our algorithm reduces the energy consumption of the processor system by 7%-20% compared to the result of a processor with a same size set associative cache memory.
書誌レコードID
収録物識別子タイプ NCID
収録物識別子 AA11451459
書誌情報 研究報告システムLSI設計技術(SLDM)

巻 2009, 号 22(2009-SLDM-139), p. 13-18, 発行日 2009-02-26
Notice
SIG Technical Reports are nonrefereed and hence may later appear in any journals, conferences, symposia, etc.
出版者
言語 ja
出版者 情報処理学会
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Ver.1 2025-01-21 22:23:07.235176
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安浦, 寛人, 2009: 情報処理学会, 13–18 p.

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