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アイテム
一時的観測不能領域抽出による超高速ベクトル化故障シミュレータの開発
https://ipsj.ixsq.nii.ac.jp/records/123901
https://ipsj.ixsq.nii.ac.jp/records/123901ca144c42-3cd6-45d9-a15c-9ff120d1150c
| 名前 / ファイル | ライセンス | アクション |
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KJ00001337748.pdf (167.2 kB)
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| Item type | National Convention(1) | |||||
|---|---|---|---|---|---|---|
| 公開日 | 1993-03-01 | |||||
| タイトル | ||||||
| タイトル | 一時的観測不能領域抽出による超高速ベクトル化故障シミュレータの開発 | |||||
| タイトル | ||||||
| 言語 | en | |||||
| タイトル | A vectorized fault simulator using dynamic reduction by excluding temporarily unobservable faults | |||||
| 言語 | ||||||
| 言語 | jpn | |||||
| 資源タイプ | ||||||
| 資源タイプ識別子 | http://purl.org/coar/resource_type/c_5794 | |||||
| 資源タイプ | conference paper | |||||
| 著者所属 | ||||||
| (株)日立製作所 | ||||||
| 著者所属 | ||||||
| (株)日立製作所 | ||||||
| 著者所属 | ||||||
| (株)日立製作所 | ||||||
| 著者所属 | ||||||
| (株)日立製作所 | ||||||
| 著者所属 | ||||||
| (株)日立製作所 | ||||||
| 著者所属(英) | ||||||
| en | ||||||
| HlTACHl. Ltd. | ||||||
| 著者所属(英) | ||||||
| en | ||||||
| HlTACHl. Ltd. | ||||||
| 著者所属(英) | ||||||
| en | ||||||
| HlTACHl. Ltd. | ||||||
| 著者所属(英) | ||||||
| en | ||||||
| HlTACHl. Ltd. | ||||||
| 著者所属(英) | ||||||
| en | ||||||
| HlTACHl. Ltd. | ||||||
| 論文抄録 | ||||||
| 内容記述タイプ | Other | |||||
| 内容記述 | 計算機を構成するLSIの製造においては、歩留まりの向上および不良品の確実な排除のため、診断の工程が不可欠である.LSIの規模は年今拡大され、この工程で使われる診断データの作成時間短縮は常に課題となっている。これに対応するための有効な診断容易化手段として、スキャン設計は現在広く用いられている.スキャン設計されたLSIは、組合せ回路部分とスキャンクロックで制御された同期順序回路部分とに別けて診断される.同期順序回路部分(スキャン回路)はRAMまたはレジスタのような単純な構造をしており、スキャンの操作そのものを組合せて完全なテスト生成を容易に実現できる.一方、故障シミュレータの高速化に関しては、組合せ回路部分を対象として数多くの有効な報告がなされているが、スキャン回路に適用できる決定的な手段はまだ一般的でない.そこで、25kゲート級LSIのスキャン回路に対して従来のソフトウェア順序回路用コンカレント故障シミュレータと比較して百倍程度高速迄なることを目標に、スーパーコンピュータの利用を前提とした故障シミュレーション(VFSIM)の開発を行った.本稿では.高速化方式の概要と、これを利用したLSIスキャン回路部分の診断システム(VITAL)の適用結果とについて報告する. | |||||
| 書誌レコードID | ||||||
| 収録物識別子タイプ | NCID | |||||
| 収録物識別子 | AN00349328 | |||||
| 書誌情報 |
全国大会講演論文集 巻 第46回, 号 ハードウェア, p. 189-190, 発行日 1993-03-01 |
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| 出版者 | ||||||
| 言語 | ja | |||||
| 出版者 | 情報処理学会 | |||||
