@techreport{oai:ipsj.ixsq.nii.ac.jp:00033050, author = {諏佐, 達也 and 村川, 正宏 and 高橋, 栄一 and 古谷, 辰立見 and 樋口, 哲也 and 古市, 愼治 and 上田, 佳孝 and 和田, 淳 and TATSUYA, SUSA and MASAHIRO, MURAKAWA and ElICHI, TAKAHASHI and TATSUMI, FURUYA and TETSUYA, HlGUCHI and SHINJI, FURUICHI and YOSHITAKA, UEDA and ATSUSHI, WADA}, issue = {19(2007-MPS-063)}, month = {Mar}, note = {製造ばらつぎにより発生するクロック・スキューの問題を解決するための手法として,遺伝的アルゴリズムを用いたディジタルLSIの製造後クロック調整技術が提案されている.しかし,大規模なLSIの調整では,鋼整箇所が増大するため,調整時間が増加するという問題がある.そこで,本研究では,大規模ディジタルLSIにも適用可能な製造後クロック調整手法を提案する.提案手法では,LSI設計時に行うSm(StaticTimmgAnalysi8)の結果を用いて調整箇所を限定し,調整時間を短縮する.それに加えて,遺伝的アルゴリズムの初期集団の分布を工夫することで,更に調整時間を短縮する.さらに,これらの手法による調整効果をLSIの設計時に検証できるようにするための調整シミュレータを開発した.このシミュレータを、いた調綣火験の$ 'i采,1031箇所ものフリップフロップが存在する実閉的な大規模LSIにおいて,数秒という現実的な時間で調整が完rできる見込みを得た., To solve the problem of fluctuations in clock timing with large scale digital LSIs (also known as the "clock skew" problem), the post-fabrication clock-timing adjustment technique using a genetic algorithm (GA) has been proposed. However, the adjustment time increases incurred when more programmable delay circuits are incorporated within large-scale LSIs is a serious issue. For this problem, we propose a post-fabrication clock adjustment method to realize practical applications. This method reduces the acUustment time by reducing adjustment points utilizing results of static timing analysis (STA) and adopting improved distribution for initial population of GA. Moreover, we have developed an adjustment simulator to predict the adjustment results by the proposed method in design stages of LSIs. Adjustment experiments using the developed simulator demonstrate that our method can adjust practical large-scale LSIs with 1031 flip-flops within a few seconds.}, title = {大規模ディジタルLSIの製造後クロック調整手法の提案と検証}, year = {2007} }