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  1. 研究報告
  2. ハイパフォーマンスコンピューティング(HPC)
  3. 2005
  4. 19(2004-HPC-101)

メモリモジュール上での等間隔アクセス連続化の効果

https://ipsj.ixsq.nii.ac.jp/records/29044
https://ipsj.ixsq.nii.ac.jp/records/29044
18b3b751-415b-422e-8da9-71a01a54d96f
名前 / ファイル ライセンス アクション
IPSJ-HPC04101024.pdf IPSJ-HPC04101024.pdf (190.1 kB)
Copyright (c) 2005 by the Information Processing Society of Japan
オープンアクセス
Item type SIG Technical Reports(1)
公開日 2005-03-08
タイトル
タイトル メモリモジュール上での等間隔アクセス連続化の効果
タイトル
言語 en
タイトル Effects of Conversion of Strided Access into Continuous Access on a Memory Module
言語
言語 jpn
資源タイプ
資源タイプ識別子 http://purl.org/coar/resource_type/c_18gh
資源タイプ technical report
著者所属
東芝
著者所属
横浜国立大学
著者所属
横浜国立大学
著者所属
横浜国立大学
著者所属
東京農工大学
著者所属
慶應義塾大学
著者所属
慶應義塾大学
著者所属
慶應義塾大学
著者所属(英)
en
TOSHIBA
著者所属(英)
en
Yokohama National University
著者所属(英)
en
Yokohama National University
著者所属(英)
en
Yokohama National University
著者所属(英)
en
Tokyo University of Agriculture and Technology
著者所属(英)
en
Keio University
著者所属(英)
en
Keio University
著者所属(英)
en
Keio University
著者名 田邊, 昇 箱崎, 博孝 安藤, 宏 土肥, 康孝 中條, 拓伯 宮代, 具隆 北村, 聡 天野, 英晴

× 田邊, 昇 箱崎, 博孝 安藤, 宏 土肥, 康孝 中條, 拓伯 宮代, 具隆 北村, 聡 天野, 英晴

田邊, 昇
箱崎, 博孝
安藤, 宏
土肥, 康孝
中條, 拓伯
宮代, 具隆
北村, 聡
天野, 英晴

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著者名(英) Noboru, Tanabe Hirotaka, Hakozaki Hiroshi, Ando Yasunori, Dohi Hironori, Nakajo Tomotaka, Miyashiro Akira, Kitamura Hideharu, Amano

× Noboru, Tanabe Hirotaka, Hakozaki Hiroshi, Ando Yasunori, Dohi Hironori, Nakajo Tomotaka, Miyashiro Akira, Kitamura Hideharu, Amano

en Noboru, Tanabe
Hirotaka, Hakozaki
Hiroshi, Ando
Yasunori, Dohi
Hironori, Nakajo
Tomotaka, Miyashiro
Akira, Kitamura
Hideharu, Amano

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論文抄録
内容記述タイプ Other
内容記述 パーソナルコンピュータ(PC)のメモリスロットに装着されるプリフェッチ機能を有するメモリモジュールを提案する.このデバイスは,PentiumなどのCOTS(Comercial Off-The-Shelf)型MPUのキャッシュアーキテクチャの弱点を軽減することで,パーソナルスーパコンピュータに匹敵する実効性能をPC上でも実現可能にすることを目指している.本論文では,プリフェッチ機構付メモリモジュールの基本コンセプトとそのソフト的対応法について述べ,DIMMnet-2プロトタイプにおける実装案を紹介する.主記憶データベースに対するWisconsinベンチマークへの適用を通し,等間隔参照の高速化に関する評価結果を示す.その結果,タプルサイズがキャッシュラインサイズより大きい場合は、最大で25.2倍の加速率を並列処理なしで得られることが判った.
論文抄録(英)
内容記述タイプ Other
内容記述 Prefetching functions in a memory module plugged into a memory slot of a PC are proposed. The proposed device overcome the defect of cache architecture of a COTS (Commercial Off-The-Shelf) type MPU such as Pentium in order to realize personal supercomputer class performance. In this paper, the concept and its software corresponding method of a memory module with prefetching functions and its implementation plan on a DIMMnet-2 prototype are presented. In addition, evaluations for improvement of a stridden access with Wisconsin benchmark programs are shown. As a result, at most 25.2 times performance improvement without parallel computation is gained, when tupple size is bigger than cache line size.
書誌レコードID
収録物識別子タイプ NCID
収録物識別子 AN10463942
書誌情報 情報処理学会研究報告ハイパフォーマンスコンピューティング(HPC)

巻 2005, 号 19(2004-HPC-101), p. 139-144, 発行日 2005-03-08
Notice
SIG Technical Reports are nonrefereed and hence may later appear in any journals, conferences, symposia, etc.
出版者
言語 ja
出版者 情報処理学会
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Ver.1 2025-01-22 17:46:30.950527
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