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少品種高信頼セルによる演算器の提案と評価
https://ipsj.ixsq.nii.ac.jp/records/26827
https://ipsj.ixsq.nii.ac.jp/records/26827f0e86e6b-387f-4827-a254-dded24cb3943
| 名前 / ファイル | ライセンス | アクション |
|---|---|---|
IPSJ-SLDM08134029.pdf (579.5 kB)
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Copyright (c) 2008 by the Information Processing Society of Japan
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| オープンアクセス | ||
| Item type | SIG Technical Reports(1) | |||||||
|---|---|---|---|---|---|---|---|---|
| 公開日 | 2008-03-28 | |||||||
| タイトル | ||||||||
| タイトル | 少品種高信頼セルによる演算器の提案と評価 | |||||||
| タイトル | ||||||||
| 言語 | en | |||||||
| タイトル | A Functional Unit with Small Variety of Highly Reliable Cells and Its Evaluation | |||||||
| 言語 | ||||||||
| 言語 | jpn | |||||||
| 資源タイプ | ||||||||
| 資源タイプ識別子 | http://purl.org/coar/resource_type/c_18gh | |||||||
| 資源タイプ | technical report | |||||||
| 著者所属 | ||||||||
| 奈良先端科学技術大学院大学 | ||||||||
| 著者所属 | ||||||||
| 奈良先端科学技術大学院大学 | ||||||||
| 著者所属 | ||||||||
| 奈良先端科学技術大学院大学 | ||||||||
| 著者所属 | ||||||||
| 奈良先端科学技術大学院大学 | ||||||||
| 著者所属 | ||||||||
| 奈良先端科学技術大学院大学 | ||||||||
| 著者所属(英) | ||||||||
| en | ||||||||
| Nara Institute of Science and Technology | ||||||||
| 著者所属(英) | ||||||||
| en | ||||||||
| Nara Institute of Science and Technology | ||||||||
| 著者所属(英) | ||||||||
| en | ||||||||
| Nara Institute of Science and Technology | ||||||||
| 著者所属(英) | ||||||||
| en | ||||||||
| Nara Institute of Science and Technology | ||||||||
| 著者所属(英) | ||||||||
| en | ||||||||
| Nara Institute of Science and Technology | ||||||||
| 著者名 |
鈴木, 一範
中田, 尚
中西, 正樹
山下, 茂
中島, 康彦
× 鈴木, 一範 中田, 尚 中西, 正樹 山下, 茂 中島, 康彦
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| 著者名(英) |
Kazunori, Suzuki
Takashi, Nakada
Masaki, Nakanishi
Shigeru, Yamashita
Yasuhiko, Nakashima
× Kazunori, Suzuki Takashi, Nakada Masaki, Nakanishi Shigeru, Yamashita Yasuhiko, Nakashima
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| 論文抄録 | ||||||||
| 内容記述タイプ | Other | |||||||
| 内容記述 | 近年のトランジスタ製造プロセスの微細化によって，トランジスタの故障率の増加が無視できない問題となっている．故障率の増加を抑える手法として，我々はトランジスタが規則的に配置されたセルを提案した．このセルはPMOSとNMOSを組み合わせたものを基本単位として構成されている．我々の提案したセルは，従来のセルに比べて壊れにくく，また故障を検出する機能を備えている．本論文ではこのセルで構成された演算器の提案および評価を行った．提案した演算器は，従来のセルで構成された演算器とトランジスタ数がほぼ同等でありながら，耐故障性に優れていることが分かった． | |||||||
| 論文抄録(英) | ||||||||
| 内容記述タイプ | Other | |||||||
| 内容記述 | Recently, the shrinking process causes growth of error rate. We have proposed new standard cells in which transistors are arranged regularly in order to reduce errors. These cells are composed of pairs of PMOS and NMOS. The proposed cells are more robust against transistor faults and can also detect them. In this paper, we propose and evaluate a functional unit that is composed of the proposed cells. The number of transistors in our proposed functional unit is comparable that by traditional cells. Moreover our proposed functional unit has better fault tolerance. | |||||||
| 書誌レコードID | ||||||||
| 収録物識別子タイプ | NCID | |||||||
| 収録物識別子 | AA11451459 | |||||||
| 書誌情報 |
情報処理学会研究報告システムLSI設計技術（SLDM） 巻 2008, 号 32(2008-SLDM-134), p. 167-172, 発行日 2008-03-28 |
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| Notice | ||||||||
| SIG Technical Reports are nonrefereed and hence may later appear in any journals, conferences, symposia, etc. | ||||||||
| 出版者 | ||||||||
| 言語 | ja | |||||||
| 出版者 | 情報処理学会 | |||||||
