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  1. 研究報告
  2. システムとLSIの設計技術(SLDM)
  3. 2024
  4. 2024-SLDM-207

ガウスジョルダン消去法とBiCGSTAB法による投機的実行線形ソルバを備えた単一FPGA上の電子回路シミュレータ実装とその性能評価

https://ipsj.ixsq.nii.ac.jp/records/240526
https://ipsj.ixsq.nii.ac.jp/records/240526
0d3c9db2-21ac-4b4e-baec-1dd23197a709
名前 / ファイル ライセンス アクション
IPSJ-SLDM24207044.pdf IPSJ-SLDM24207044.pdf (1.4 MB)
Copyright (c) 2024 by the Institute of Electronics, Information and Communication Engineers This SIG report is only available to those in membership of the SIG.
SLDM:会員:¥0, DLIB:会員:¥0
Item type SIG Technical Reports(1)
公開日 2024-11-05
タイトル
タイトル ガウスジョルダン消去法とBiCGSTAB法による投機的実行線形ソルバを備えた単一FPGA上の電子回路シミュレータ実装とその性能評価
タイトル
言語 en
タイトル Implementation and Performance Evaluation of an FPGA-Based Electronic Circuit Simulator with a Speculative Execution Linear Solver using Gauss-Jordan Elimination and the BiCGSTAB Method
言語
言語 jpn
資源タイプ
資源タイプ識別子 http://purl.org/coar/resource_type/c_18gh
資源タイプ technical report
著者所属
広島市立大学
著者所属
広島市立大学
著者所属
広島市立大学
著者所属
広島市立大学
著者所属(英)
en
Hiroshima City University
著者所属(英)
en
Hiroshima City University
著者所属(英)
en
Hiroshima City University
著者所属(英)
en
Hiroshima City University
著者名 周東, 裕也

× 周東, 裕也

周東, 裕也

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大本, 裕真

× 大本, 裕真

大本, 裕真

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窪田, 昌史

× 窪田, 昌史

窪田, 昌史

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弘中, 哲夫

× 弘中, 哲夫

弘中, 哲夫

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著者名(英) Yuya, Shuto

× Yuya, Shuto

en Yuya, Shuto

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Yuma, Omoto

× Yuma, Omoto

en Yuma, Omoto

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Atsushi, Kubota

× Atsushi, Kubota

en Atsushi, Kubota

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Tetsuo, Hironaka

× Tetsuo, Hironaka

en Tetsuo, Hironaka

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論文抄録
内容記述タイプ Other
内容記述 To accelerate electronic circuit simulation, we propose a speculative execution linear solver that combines the Gauss-Jordan Elimination (GJE) method and the BiCGSTAB method. The solver is implemented on an FPGA, enabling both methods to run in parallel. The result from the first method to complete is adopted, automatically selecting the fastest solution approach. Evaluation of a simulator implemented on the ZCU104, with support for a matrix size of 20 × 20, demonstrated that the GJE method is effective for small matrices, while the BiCGSTAB method performs better for larger matrices or under certain conditions.
論文抄録(英)
内容記述タイプ Other
内容記述 To accelerate electronic circuit simulation, we propose a speculative execution linear solver that combines the Gauss-Jordan Elimination (GJE) method and the BiCGSTAB method. The solver is implemented on an FPGA, enabling both methods to run in parallel. The result from the first method to complete is adopted, automatically selecting the fastest solution approach. Evaluation of a simulator implemented on the ZCU104, with support for a matrix size of 20 × 20, demonstrated that the GJE method is effective for small matrices, while the BiCGSTAB method performs better for larger matrices or under certain conditions.
書誌レコードID
収録物識別子タイプ NCID
収録物識別子 AA11451459
書誌情報 研究報告システムとLSIの設計技術(SLDM)

巻 2024-SLDM-207, 号 44, p. 1-6, 発行日 2024-11-05
ISSN
収録物識別子タイプ ISSN
収録物識別子 2188-8639
Notice
SIG Technical Reports are nonrefereed and hence may later appear in any journals, conferences, symposia, etc.
出版者
言語 ja
出版者 情報処理学会
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Ver.1 2025-01-19 07:57:07.749251
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