WEKO3
アイテム
相互結合網評価用命令レベルシミュレーション
https://ipsj.ixsq.nii.ac.jp/records/23801
https://ipsj.ixsq.nii.ac.jp/records/2380137d43316-c1cc-41bc-b3f1-4d5854722163
| 名前 / ファイル | ライセンス | アクション |
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Copyright (c) 1999 by the Information Processing Society of Japan
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| オープンアクセス | ||
| Item type | SIG Technical Reports(1) | |||||||
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| 公開日 | 1999-03-04 | |||||||
| タイトル | ||||||||
| タイトル | 相互結合網評価用命令レベルシミュレーション | |||||||
| タイトル | ||||||||
| 言語 | en | |||||||
| タイトル | An Evaluation System of Interconnection Networks | |||||||
| 言語 | ||||||||
| 言語 | jpn | |||||||
| 資源タイプ | ||||||||
| 資源タイプ識別子 | http://purl.org/coar/resource_type/c_18gh | |||||||
| 資源タイプ | technical report | |||||||
| 著者所属 | ||||||||
| 日立公共システムエンジニアリング | ||||||||
| 著者所属 | ||||||||
| 慶應義塾大学理工学部 | ||||||||
| 著者所属 | ||||||||
| 慶應義塾大学理工学部 | ||||||||
| 著者所属(英) | ||||||||
| en | ||||||||
| Hitachi Government and Public Corporation System Engineering | ||||||||
| 著者所属(英) | ||||||||
| en | ||||||||
| Keio University | ||||||||
| 著者所属(英) | ||||||||
| en | ||||||||
| Keio University | ||||||||
| 著者名 |
小守, 継夫
若林, 正樹
天野, 英晴
× 小守, 継夫 若林, 正樹 天野, 英晴
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| 著者名(英) |
Tsugio, Komori
Masaki, Wakabayashi
Hideharu, Amano
× Tsugio, Komori Masaki, Wakabayashi Hideharu, Amano
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| 論文抄録 | ||||||||
| 内容記述タイプ | Other | |||||||
| 内容記述 | 慶應義塾大学では並列計算機の性能評価を目的に,並列計算機シミュレータライブラリISISと相互結合網シミュレータライブラリSPIDERを開発している.本研究では,これらのライブラリを利用して分散共有メモリ型並列計算機モデルであるNUMAのシミュレーションを行うため,新たな機能ブロックとしてネットワークインタフェースを開発してライブラリの拡張を行った.本稿では,ライブラリの拡張方法と,実装した幾つかのシミュレータ上でSPLASH2プログラム集を実行して性能評価を行った結果を示す.本研究により,様々な相互結合網について命令レベルシミュレーションによる性能評価を可能にした. | |||||||
| 論文抄録(英) | ||||||||
| 内容記述タイプ | Other | |||||||
| 内容記述 | A instruction level simulation library "ISIS" which is developed by Keio University supports to simulate a bus connected multiprocessor. On the other hand, "SPIDER" which is also developed by us supports to simulate an interconnection networks. Here, these two simulation libraries are combined to simulate a large scale multiprocesor connected with an interconnection network. We also implemented several distributed shared memory mulitprocessor simulator based on the new library. In this paper, the new extension method of library is described, and performance evaluation of the implemented simulator is shown. | |||||||
| 書誌レコードID | ||||||||
| 収録物識別子タイプ | NCID | |||||||
| 収録物識別子 | AN10096105 | |||||||
| 書誌情報 |
情報処理学会研究報告計算機アーキテクチャ(ARC) 巻 1999, 号 21(1998-ARC-132), p. 1-6, 発行日 1999-03-04 |
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| Notice | ||||||||
| SIG Technical Reports are nonrefereed and hence may later appear in any journals, conferences, symposia, etc. | ||||||||
| 出版者 | ||||||||
| 言語 | ja | |||||||
| 出版者 | 情報処理学会 | |||||||