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  1. 研究報告
  2. システムとLSIの設計技術(SLDM)
  3. 2023
  4. 2023-SLDM-203

ビット削減を考慮したSMTVソルバによるNNA回路合成手法

https://ipsj.ixsq.nii.ac.jp/records/228837
https://ipsj.ixsq.nii.ac.jp/records/228837
3a393dc2-d005-4878-8790-6d4aaf97a6b3
名前 / ファイル ライセンス アクション
IPSJ-SLDM23203002.pdf IPSJ-SLDM23203002.pdf (819.3 kB)
 2025年10月31日からダウンロード可能です。
Copyright (c) 2023 by the Information Processing Society of Japan
非会員:¥660, IPSJ:学会員:¥330, SLDM:会員:¥0, DLIB:会員:¥0
Item type SIG Technical Reports(1)
公開日 2023-10-31
タイトル
タイトル ビット削減を考慮したSMTVソルバによるNNA回路合成手法
言語
言語 jpn
キーワード
主題Scheme Other
主題 ポスター
資源タイプ
資源タイプ識別子 http://purl.org/coar/resource_type/c_18gh
資源タイプ technical report
著者所属
立命館大学大学院情報理工学研究科
著者所属
立命館大学大学院情報理工学研究科
著者所属(英)
en
Graduate School of Information Science and Engineering, Ritsumeikan University
著者所属(英)
en
Graduate School of Information Science and Engineering, Ritsumeikan University
著者名 清野, 恭平

× 清野, 恭平

清野, 恭平

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山下, 茂

× 山下, 茂

山下, 茂

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論文抄録
内容記述タイプ Other
内容記述 量子コンピュータにおける演算の際に,環境との相互作用によって量子重ね合わせ状態が失われる量子デコヒーレンスが生じる場合がある.そのため,演算する量子ビットを隣接させる NNA(Nearest Neigbor Architecture)制約という制約が存在する.NNA 制約を満たす量子回路は NNA 回路と呼ばれる.しかし,一般に量子回路を NNA 回路に変換すると CNOT ゲート数が大幅に増加する.CNOT ゲート数が増加するとエラー率が上昇するため,量子回路を NNA 回路に変換する際に増加する CNOT ゲート数を削減することが求められる.本論文では,T ゲートの性質に着目して,ドントケアな量子ビットと,T ゲートの量子ビット間の移動を考慮し,より最適な NNA 回路設計を提案する.T ゲートは作用させる直前の量子状態が同一であれば,それまで作用させる量子ビットがどのような量子状態であっても,回路全体の動作は変わらない.また,作用させる量子状態が同一であれば,量子状態が等しい任意の量子ビットに作用させることが可能である.本論文ではこの二つを考慮することにより,従来よりもより自由度の高い NNA 回路の設計手法を提案する.
書誌レコードID
収録物識別子タイプ NCID
収録物識別子 AA11451459
書誌情報 研究報告システムとLSIの設計技術(SLDM)

巻 2023-SLDM-203, 号 2, p. 1-3, 発行日 2023-10-31
ISSN
収録物識別子タイプ ISSN
収録物識別子 2188-8639
Notice
SIG Technical Reports are nonrefereed and hence may later appear in any journals, conferences, symposia, etc.
出版者
言語 ja
出版者 情報処理学会
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Ver.1 2025-01-19 11:42:02.667773
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