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  1. 研究報告
  2. システム・アーキテクチャ(ARC)
  3. 2019
  4. 2019-ARC-237

計算再利用を用いたプロセッサ省電力化の検討

https://ipsj.ixsq.nii.ac.jp/records/198381
https://ipsj.ixsq.nii.ac.jp/records/198381
3c5e95db-7bed-4893-a5b4-b1c94f256b5a
名前 / ファイル ライセンス アクション
IPSJ-ARC19237006.pdf IPSJ-ARC19237006.pdf (1.4 MB)
Copyright (c) 2019 by the Information Processing Society of Japan
オープンアクセス
Item type SIG Technical Reports(1)
公開日 2019-07-17
タイトル
タイトル 計算再利用を用いたプロセッサ省電力化の検討
言語
言語 jpn
キーワード
主題Scheme Other
主題 プロセッサ
資源タイプ
資源タイプ識別子 http://purl.org/coar/resource_type/c_18gh
資源タイプ technical report
著者所属
名古屋工業大学
著者所属
名古屋工業大学
著者所属
奈良先端科学技術大学院大学
著者所属(英)
en
Nagoya Institute of Technology
著者所属(英)
en
Nagoya Institute of Technology
著者所属(英)
en
Nara Institute of Science and Technology
著者名 武石, 隆太郎

× 武石, 隆太郎

武石, 隆太郎

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津邑, 公暁

× 津邑, 公暁

津邑, 公暁

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中島, 康彦

× 中島, 康彦

中島, 康彦

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論文抄録
内容記述タイプ Other
内容記述 ゲート遅延に対する配線遅延の相対的な増大から,集積回路の微細化による高クロック化だけではマイクロプロセッサの性能向上を実現することは困難になってきた.こうした中で,SIMD やスーパースカラなどの命令間の並列性に着目した高速化手法が注目されるようになった.しかし,プログラム中の並列性を持つ部分全てに並列化を適用するのは困難なため,これらの手法よる性能向上にも限界がある.並列化による高速化が注目される一方で,我々は独自性の高い計算再利用に基づく高速化手法を採用した自動メモ化プロセッサを提案している.計算再利用とは処理の実行自体を省略することで高速化を図る手法であるが,実行の省略により,実行に必要なプロセッサユニットでの動的消費電力が低減するため,消費電力削減にも効果がある可能性がある.そこで本稿では,計算再利用が持つ,プロセッサ省電力化に対するポテンシャルを検証するため,自動メモ化プロセッサの詳細な電力評価を行った.評価の結果,一部のベンチマークにおいてはプログラムの実行に必要な消費エネルギーが減少することを確認した.
書誌レコードID
収録物識別子タイプ NCID
収録物識別子 AN10096105
書誌情報 研究報告システム・アーキテクチャ(ARC)

巻 2019-ARC-237, 号 6, p. 1-7, 発行日 2019-07-17
ISSN
収録物識別子タイプ ISSN
収録物識別子 2188-8574
Notice
SIG Technical Reports are nonrefereed and hence may later appear in any journals, conferences, symposia, etc.
出版者
言語 ja
出版者 情報処理学会
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Ver.1 2025-01-19 22:03:20.019432
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