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  1. 研究報告
  2. システムとLSIの設計技術(SLDM)
  3. 2018
  4. 2018-SLDM-182

176MHz WXGA 30fps実時間オプテイカルフロー推定プロセッサの設計及び実装

https://ipsj.ixsq.nii.ac.jp/records/185156
https://ipsj.ixsq.nii.ac.jp/records/185156
be318bfb-f81a-45ab-9246-43032ab0afb2
名前 / ファイル ライセンス アクション
IPSJ-SLDM18182018.pdf IPSJ-SLDM18182018.pdf (1.5 MB)
Copyright (c) 2018 by the Institute of Electronics, Information and Communication Engineers This SIG report is only available to those in membership of the SIG.
SLDM:会員:¥0, DLIB:会員:¥0
Item type SIG Technical Reports(1)
公開日 2018-01-11
タイトル
タイトル 176MHz WXGA 30fps実時間オプテイカルフロー推定プロセッサの設計及び実装
タイトル
言語 en
タイトル Design and Implementation of 176-MHz WXGA 30-fps Real-time Optical Flow Processor
言語
言語 jpn
キーワード
主題Scheme Other
主題 プログラマブルアーキテクチャ
資源タイプ
資源タイプ識別子 http://purl.org/coar/resource_type/c_18gh
資源タイプ technical report
著者所属
日本大学大学院工学研究科
著者所属
日本大学大学院工学研究科
著者所属
日本大学大学院工学研究科
著者所属
金沢大学理工研究域電子情報学系
著者所属
金沢大学理工研究域電子情報学系
著者所属
日本大学大学院工学研究科
著者名 神田, 哲志

× 神田, 哲志

神田, 哲志

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鈴木, 悠

× 鈴木, 悠

鈴木, 悠

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伊藤, 雅人

× 伊藤, 雅人

伊藤, 雅人

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今村, 幸祐

× 今村, 幸祐

今村, 幸祐

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松田, 吉雄

× 松田, 吉雄

松田, 吉雄

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松村, 哲哉

× 松村, 哲哉

松村, 哲哉

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著者名(英) Satoshi, Kanda

× Satoshi, Kanda

en Satoshi, Kanda

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Yu, Suzuki

× Yu, Suzuki

en Yu, Suzuki

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Masato, Ito

× Masato, Ito

en Masato, Ito

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Kousuke, Imamura

× Kousuke, Imamura

en Kousuke, Imamura

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Yoshio, Matsuda

× Yoshio, Matsuda

en Yoshio, Matsuda

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Tetsuya, Matsumura

× Tetsuya, Matsumura

en Tetsuya, Matsumura

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論文抄録
内容記述タイプ Other
内容記述 本稿では,実時間オプティカルフロープロセッサの設計及び FPGA 実装について報告する.このプロセッサは新規手法として,初期値生成手法の改善手法,階層別 Successive over relaxation (SOR) 手法,逆数演算手法の改善手法および画素境界面におけるオーバーラップ画素数の最適化手法の 4 種の新規手法を導入し,従来の階層オプテイカルフロープロセッサに比較して,演算量を低減しつつフロー検出精度を改善した.さらにこのプロセッサにパイプラインを適用することで,スループットを改善したハードウェアを設計した.その結果,著者らが以前提案したプロセッサに比べ,計算部の回路規模を 8%,全体のメモリ量を 16% 削減できた.FPGA 1 チップで wide extended graphics array (WXGA) 30-fps を 175.5 MHz で実時間処理可能なプロセッサを実現した.
論文抄録(英)
内容記述タイプ Other
内容記述 This paper describes the design and implementation of a real-time optical flow processor using a single field-programmable gate array (FPGA) chip. By introducing the modified initial flow generation method, the successive over-relaxation (SOR) method for both layers, the optimization of the reciprocal operation method, and the image division method, it is now possible to both reduce hardware requirements and improve flow accuracy. Additionally, by introducing a pipeline structure to this processor, high-throughput hardware implementation could be achieved. Total logic cell (LC) amounts and processor memory capacity are reduced by about 8% and 16%, respectively, compared to our previous hierarchical optical flow estimation (HOE) processor. The results of our evaluation confirm that this processor can perform 30-fps wide extended graphics array (WXGA) 175.7 MHz real-time optical flow processing with a single FPGA.
書誌レコードID
収録物識別子タイプ NCID
収録物識別子 AA11451459
書誌情報 研究報告システムとLSIの設計技術(SLDM)

巻 2018-SLDM-182, 号 18, p. 1-6, 発行日 2018-01-11
ISSN
収録物識別子タイプ ISSN
収録物識別子 2188-8639
Notice
SIG Technical Reports are nonrefereed and hence may later appear in any journals, conferences, symposia, etc.
出版者
言語 ja
出版者 情報処理学会
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Ver.1 2025-01-20 03:03:31.467009
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