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  1. 研究報告
  2. システムとLSIの設計技術(SLDM)
  3. 2017
  4. 2017-SLDM-181

IDDT出現時間に基づく検査法の断線故障検出能力向上のための設計

https://ipsj.ixsq.nii.ac.jp/records/183965
https://ipsj.ixsq.nii.ac.jp/records/183965
619e116d-e762-4208-84c8-a1f11b8da34d
名前 / ファイル ライセンス アクション
IPSJ-SLDM17181024.pdf IPSJ-SLDM17181024.pdf (1.2 MB)
Copyright (c) 2017 by the Institute of Electronics, Information and Communication Engineers This SIG report is only available to those in membership of the SIG.
SLDM:会員:¥0, DLIB:会員:¥0
Item type SIG Technical Reports(1)
公開日 2017-10-30
タイトル
タイトル IDDT出現時間に基づく検査法の断線故障検出能力向上のための設計
タイトル
言語 en
タイトル Design to Improve Open Defect Detection for Test Based on IDDT Appearance Time
言語
言語 jpn
キーワード
主題Scheme Other
主題 ストカスティック論理設計およびテスト容易化設計
資源タイプ
資源タイプ識別子 http://purl.org/coar/resource_type/c_18gh
資源タイプ technical report
著者所属
徳島大学大学院先端技術科学教育部システム創生工学専攻電気電子創生工学コース
著者所属
徳島大学大学院先端技術科学教育部システム創生工学専攻電気電子創生工学コース
著者所属
徳島大学大学院社会産業理工学研究部
著者所属
徳島大学大学院社会産業理工学研究部
著者所属(英)
en
Graduate School of Advanced Technology and Science, Tokushima University
著者所属(英)
en
Graduate School of Advanced Technology and Science, Tokushima University
著者所属(英)
en
Graduate School of Science and Technology, Industrial and Social Sciences Tokushima University
著者所属(英)
en
Graduate School of Science and Technology, Industrial and Social Sciences Tokushima University
著者名 神原, 東風

× 神原, 東風

神原, 東風

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大谷, 航平

× 大谷, 航平

大谷, 航平

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四柳, 浩之

× 四柳, 浩之

四柳, 浩之

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橋爪, 正樹

× 橋爪, 正樹

橋爪, 正樹

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著者名(英) Ayumu, Kambara

× Ayumu, Kambara

en Ayumu, Kambara

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Kouhei, Ohtani

× Kouhei, Ohtani

en Kouhei, Ohtani

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Hiroyuki, Yotsuyanagi

× Hiroyuki, Yotsuyanagi

en Hiroyuki, Yotsuyanagi

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Masaki, Hashizume

× Masaki, Hashizume

en Masaki, Hashizume

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論文抄録
内容記述タイプ Other
内容記述 IC 内に発生する断線故障の増加が問題となっている.これまでに我々は CMOS 論理回路内の信号線における断線故障を検出するための組込みセンサを用いる電源電流検査法を提案した.この検査法はテスト入力ベクトルを検査対象デバイスに印加した際に流れる動的電源電流の出現時間に基づいている.本稿では検査時に故障回路と正常回路の動的電源電流出現時間の差異を拡大するための検査法の改良を提案する.また,改良した組込みセンサを用いることで断線故障の検出が容易になることを SPICE シミュレーションを用いる実験により示す.
論文抄録(英)
内容記述タイプ Other
内容記述 Increasing open defects has become a problem. We proposed a supply current test method with a built-in sensor for detecting open defects on signal lines in CMOS logic circuits. The test method is based on an appearance time of dynamic supply current that flows when a test input vector is provided to a device under test. We propose the improved test method to make the difference of IDDT appearance time greater. In addition, SPICE simulation results show that open defects are detected by the improved sensor.
書誌レコードID
収録物識別子タイプ NCID
収録物識別子 AA11451459
書誌情報 研究報告システムとLSIの設計技術(SLDM)

巻 2017-SLDM-181, 号 24, p. 1-6, 発行日 2017-10-30
ISSN
収録物識別子タイプ ISSN
収録物識別子 2188-8639
Notice
SIG Technical Reports are nonrefereed and hence may later appear in any journals, conferences, symposia, etc.
出版者
言語 ja
出版者 情報処理学会
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Ver.1 2025-01-20 03:27:45.239321
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