Item type |
Symposium(1) |
公開日 |
2017-08-23 |
タイトル |
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タイトル |
集積ナノフォトニクスに基づく光アナログ加算手法と光並列乗算器への適用 |
タイトル |
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言語 |
en |
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タイトル |
Optical Analog Addition and Its Application to an Optical Parallel Multiplier based on Integrated Nanophotonic Technologies |
言語 |
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言語 |
jpn |
キーワード |
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主題Scheme |
Other |
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主題 |
ナノフォトニクス |
資源タイプ |
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資源タイプ識別子 |
http://purl.org/coar/resource_type/c_5794 |
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資源タイプ |
conference paper |
著者所属 |
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京都大学大学院情報学研究科 |
著者所属 |
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京都大学大学院情報学研究科 |
著者所属 |
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京都大学大学院情報学研究科 |
著者所属 |
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NTTナノフォトニクスセンタ/NTT物性科学基礎研究所 |
著者所属 |
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NTTナノフォトニクスセンタ/NTT物性科学基礎研究所 |
著者所属 |
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NTTナノフォトニクスセンタ/NTT物性科学基礎研究所 |
著者所属 |
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NTTナノフォトニクスセンタ/NTT物性科学基礎研究所 |
著者所属 |
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NTTナノフォトニクスセンタ/NTT物性科学基礎研究所 |
著者所属(英) |
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en |
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NTT Nanophotonics Center / NTT Basic Research Laboratories |
著者所属(英) |
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en |
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NTT Nanophotonics Center / NTT Basic Research Laboratories |
著者所属(英) |
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en |
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NTT Nanophotonics Center / NTT Basic Research Laboratories |
著者所属(英) |
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en |
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NTT Nanophotonics Center / NTT Basic Research Laboratories |
著者所属(英) |
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en |
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NTT Nanophotonics Center / NTT Basic Research Laboratories |
著者名 |
今井, 悠貴
石原, 亨
小野寺, 秀俊
新家, 昭彦
北, 翔太
野崎, 謙悟
高田, 健太
納富, 雅也
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著者名(英) |
Yuuki, Imai
Tohru, Ishihara
Hidetoshi, Onodera
Akihiko, Shinya
Shota, Kita
Kengo, Nozaki
Kenta, Takata
Masaya, Notomi
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論文抄録 |
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内容記述タイプ |
Other |
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内容記述 |
近年,ナノフォトニクス技術に基づき,光スイッチや光配線を LSI のように集積化した光集積回路の研究が注目を集めている.光配線および光スイッチは,配線内の寄生抵抗や寄生容量によらず光の速度で信号を伝搬することが可能であり,演算処理に応用することで高速な演算器の実現が期待される.本稿では,ナノフォトニクス技術を用いた高速な光アナログ加算手法を提案し,さらに,乗算における部分積加算に光アナログ加算手法を適応した際の光並列乗算器の回路構成を提案する.また,提案構成に基づく光並列乗算器と CMOS 論理ゲートによる並列乗算器に関して,回路シミュレーションにより遅延時間の比較評価を行う. |
論文抄録(英) |
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内容記述タイプ |
Other |
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内容記述 |
Integrated optical circuits with nanophotonic devices have attracted attention over the recent years. Optical circuits composed of optical wires and optical switches have a potential for low-power operation and light-speed computation. Due to the potential, high performance arithmetic units are expected to be realized using the nanophotonic devices. This paper first proposes an method of optical analog addition and an architecture of an optical parallel multiplier using the optical analog addition. Next, this paper compares the performance of a CMOS parallel multiplier and the proposed optical parallel multiplier using optoelectronic circuit simulation. |
書誌情報 |
DAシンポジウム2017論文集
巻 2017,
p. 51-56,
発行日 2017-08-23
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出版者 |
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言語 |
ja |
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出版者 |
情報処理学会 |