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  1. 研究報告
  2. システム・アーキテクチャ(ARC)
  3. 2016
  4. 2016-ARC-222

セキュアプロセッサを用いたマルチプロセッサシステムの設計

https://ipsj.ixsq.nii.ac.jp/records/174803
https://ipsj.ixsq.nii.ac.jp/records/174803
6a944a1e-c47f-49f7-bed3-f953f00312d7
名前 / ファイル ライセンス アクション
IPSJ-ARC16222003.pdf IPSJ-ARC16222003.pdf (354.8 kB)
Copyright (c) 2016 by the Institute of Electronics, Information and Communication Engineers This SIG report is only available to those in membership of the SIG.
ARC:会員:¥0, DLIB:会員:¥0
Item type SIG Technical Reports(1)
公開日 2016-09-29
タイトル
タイトル セキュアプロセッサを用いたマルチプロセッサシステムの設計
タイトル
言語 en
タイトル Multi-Processor System Design with Secure Processors
言語
言語 jpn
キーワード
主題Scheme Other
主題 ポスタ・デモセッション
資源タイプ
資源タイプ識別子 http://purl.org/coar/resource_type/c_18gh
資源タイプ technical report
著者所属
東京大学情報理工学系研究科
著者所属
東京大学情報理工学系研究科
著者所属
東京大学情報理工学系研究科
著者所属
東京大学情報理工学系研究科
著者所属(英)
en
Graduate School of Information Science and Technology, The University of Tokyo
著者所属(英)
en
Graduate School of Information Science and Technology, The University of Tokyo
著者所属(英)
en
Graduate School of Information Science and Technology, The University of Tokyo
著者所属(英)
en
Graduate School of Information Science and Technology, The University of Tokyo
著者名 梶原,拓也

× 梶原,拓也

梶原,拓也

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宮永,瑞紀

× 宮永,瑞紀

宮永,瑞紀

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入江,英嗣

× 入江,英嗣

入江,英嗣

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坂井,修一

× 坂井,修一

坂井,修一

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著者名(英) Takuya, Kajiwara

× Takuya, Kajiwara

en Takuya, Kajiwara

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Mizuki Miyanaga

× Mizuki Miyanaga

en Mizuki Miyanaga

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Hidetsugu Irie

× Hidetsugu Irie

en Hidetsugu Irie

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Shuichi, Sakai

× Shuichi, Sakai

en Shuichi, Sakai

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論文抄録
内容記述タイプ Other
内容記述 セキユアプロセッサは暗号化機構と完全性検証機構によってデータを保護するが,現状ではその普及が進んでいるとは言えない.この理由の 1 つに,セキュアプロセッサがマルチプロセッサ環境に対応していないことによるパフォーマンスの低下が挙げられる.本稿では,セキュアプロセッサを用いてマルチプロセッサシステムを構成することでパフォーマンスの向上を目指し,その設計を論じる.
論文抄録(英)
内容記述タイプ Other
内容記述 A secure processor enables secure computing by protecting data from malicious users by encryption of data and integrity check. Despite of the strong security feature, secure processors cannot frequently be seen in commercial scene. One of reasons is that a secure processor cannot work as multi-processor system. A system with single secure processor cannot process data as fast as existing multi-processor system. In this paper, we propose methods to enable multi secure processors on the same board to work harmoniously.
書誌レコードID
収録物識別子タイプ NCID
収録物識別子 AN10096105
書誌情報 研究報告システム・アーキテクチャ(ARC)

巻 2016-ARC-222, 号 3, p. 1-4, 発行日 2016-09-29
ISSN
収録物識別子タイプ ISSN
収録物識別子 2188-8574
Notice
SIG Technical Reports are nonrefereed and hence may later appear in any journals, conferences, symposia, etc.
出版者
言語 ja
出版者 情報処理学会
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Ver.1 2025-01-20 06:31:02.375523
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