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Hybrid Processor Architecture FaRMqs in Verilog HDL
https://ipsj.ixsq.nii.ac.jp/records/171703
https://ipsj.ixsq.nii.ac.jp/records/17170347113aae-8db8-4d71-9833-6aaecb086a28
| 名前 / ファイル | ライセンス | アクション |
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IPSJ-Z67-1ZB-02.pdf (47.1 kB)
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Copyright (c) 2005 by the Information Processing Society of Japan
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| オープンアクセス | ||
| Item type | National Convention(1) | |||||||||||||
|---|---|---|---|---|---|---|---|---|---|---|---|---|---|---|
| 公開日 | 2005-03-02 | |||||||||||||
| タイトル | ||||||||||||||
| タイトル | Hybrid Processor Architecture FaRMqs in Verilog HDL | |||||||||||||
| 言語 | ||||||||||||||
| 言語 | jpn | |||||||||||||
| キーワード | ||||||||||||||
| 主題Scheme | Other | |||||||||||||
| 主題 | アーキテクチャ | |||||||||||||
| 資源タイプ | ||||||||||||||
| 資源タイプ識別子 | http://purl.org/coar/resource_type/c_5794 | |||||||||||||
| 資源タイプ | conference paper | |||||||||||||
| 著者名 |
Md., Musfiquzzaman Akanda
× Md., Musfiquzzaman Akanda
× 曽和, 将容
× 吉永, 努
× Abderazek, Ben
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| 書誌レコードID | ||||||||||||||
| 収録物識別子タイプ | NCID | |||||||||||||
| 収録物識別子 | AN00349328 | |||||||||||||
| 書誌情報 |
第67回全国大会講演論文集 巻 2005, 号 1, p. 127-128, 発行日 2005-03-02 |
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| 出版者 | ||||||||||||||
| 言語 | ja | |||||||||||||
| 出版者 | 情報処理学会 | |||||||||||||
