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アイテム
共有バスで接続されたマルチプロセッサのキャッシュメモリ構成
https://ipsj.ixsq.nii.ac.jp/records/15970
https://ipsj.ixsq.nii.ac.jp/records/159706e75c129-0cbe-4f12-bf57-52d3140e353e
名前 / ファイル | ライセンス | アクション |
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![]() |
Copyright (c) 1984 by the Information Processing Society of Japan
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オープンアクセス |
Item type | Journal(1) | |||||||
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公開日 | 1984-03-15 | |||||||
タイトル | ||||||||
タイトル | 共有バスで接続されたマルチプロセッサのキャッシュメモリ構成 | |||||||
タイトル | ||||||||
言語 | en | |||||||
タイトル | Cache Memory for Bus - Structured Multiprocessor System | |||||||
言語 | ||||||||
言語 | jpn | |||||||
キーワード | ||||||||
主題Scheme | Other | |||||||
主題 | 論文 | |||||||
資源タイプ | ||||||||
資源タイプ識別子 | http://purl.org/coar/resource_type/c_6501 | |||||||
資源タイプ | journal article | |||||||
著者所属 | ||||||||
(株)日立製作所日立研究所 | ||||||||
著者所属 | ||||||||
(株)日立製作所日立研究所 | ||||||||
著者所属 | ||||||||
(株)日立製作所日立研究所 | ||||||||
著者所属 | ||||||||
(株)日立製作所大みか工場 | ||||||||
著者所属 | ||||||||
(株)日立製作所大みか工場 | ||||||||
著者所属(英) | ||||||||
en | ||||||||
Hitachi Research Laboratory, Hitachi, Ltd | ||||||||
著者所属(英) | ||||||||
en | ||||||||
Hitachi Research Laboratory, Hitachi, Ltd | ||||||||
著者所属(英) | ||||||||
en | ||||||||
Hitachi Research Laboratory, Hitachi, Ltd | ||||||||
著者所属(英) | ||||||||
en | ||||||||
Omika Works, Hitachi, Ltd | ||||||||
著者所属(英) | ||||||||
en | ||||||||
Omika Works, Hitachi, Ltd | ||||||||
著者名 |
福永, 泰
× 福永, 泰
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著者名(英) |
Yasushi, Fukunaga
× Yasushi, Fukunaga
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論文抄録 | ||||||||
内容記述タイプ | Other | |||||||
内容記述 | モジュール性のよい共有バスで互いに接続されたマルチプロセッサ方式におけるキャッシュメモリの構成について考察した.検討の中心は プロセッサ個別にローカルキャッシュメモリを設けた場合 各プロセッサの高性能化と 共有バスの負荷低減とのトレードオフを とくにオンラインリアルタイムで動作するというきびしい条件で定量評価したことである.その結果 (1)16バイトの比較的小さいブロックサイズのキャッシュメモリをプロセッサ側に実装することにより 実効メモリリードサイクル数を20%に減少でき かつバスの負荷を30%に減少できること (2)オンラインでタスクスイッチが2msに1回の割合で発生する環境においても 実効性能が1MIPSの計算機では 90%以上のヒット率が得られること を明らかにした. | |||||||
書誌レコードID | ||||||||
収録物識別子タイプ | NCID | |||||||
収録物識別子 | AN00116647 | |||||||
書誌情報 |
情報処理学会論文誌 巻 25, 号 2, p. 293-297, 発行日 1984-03-15 |
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ISSN | ||||||||
収録物識別子タイプ | ISSN | |||||||
収録物識別子 | 1882-7764 |