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アイテム
バス結合による並列処理システムのハードウエア化
https://ipsj.ixsq.nii.ac.jp/records/124825
https://ipsj.ixsq.nii.ac.jp/records/1248251bc309d2-c351-4f28-9733-26cf9799644d
| 名前 / ファイル | ライセンス | アクション |
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KJ00001339330.pdf (150.6 kB)
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| Item type | National Convention(1) | |||||
|---|---|---|---|---|---|---|
| 公開日 | 1993-09-27 | |||||
| タイトル | ||||||
| タイトル | バス結合による並列処理システムのハードウエア化 | |||||
| タイトル | ||||||
| 言語 | en | |||||
| タイトル | Hardware Implementation of Nus Connected Parallel Processing System | |||||
| 言語 | ||||||
| 言語 | jpn | |||||
| 資源タイプ | ||||||
| 資源タイプ識別子 | http://purl.org/coar/resource_type/c_5794 | |||||
| 資源タイプ | conference paper | |||||
| 著者所属 | ||||||
| 防衛大学校情報工学教室 | ||||||
| 著者所属 | ||||||
| 防衛大学校情報工学教室 | ||||||
| 著者所属 | ||||||
| 防衛大学校情報工学教室 | ||||||
| 著者所属(英) | ||||||
| en | ||||||
| Department of Computer Science, National Defense Academy | ||||||
| 著者所属(英) | ||||||
| en | ||||||
| Department of Computer Science, National Defense Academy | ||||||
| 著者所属(英) | ||||||
| en | ||||||
| Department of Computer Science, National Defense Academy | ||||||
| 論文抄録 | ||||||
| 内容記述タイプ | Other | |||||
| 内容記述 | 粒度の大きい並列処理システムの課題の一つに通信や同期に係る高速化がある。この課題を解決する1つの試みとして、我々は分散並列決定方式のアービタを使ったバス結合方式によるMIMD型並列処理システムを提案し、現在そのハードウェア化を進めている。本稿においては、このハードウェアシステムの概要を報告する。 | |||||
| 書誌レコードID | ||||||
| 収録物識別子タイプ | NCID | |||||
| 収録物識別子 | AN00349328 | |||||
| 書誌情報 |
全国大会講演論文集 巻 第47回, 号 ハードウェア, p. 37-38, 発行日 1993-09-27 |
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| 出版者 | ||||||
| 言語 | ja | |||||
| 出版者 | 情報処理学会 | |||||
