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  1. 全国大会
  2. 33回
  3. 情報システム

MOS論理回路のタイミングシミュレーションの一方法

https://ipsj.ixsq.nii.ac.jp/records/114865
https://ipsj.ixsq.nii.ac.jp/records/114865
3470c54a-68cd-415d-99be-e58342f27598
名前 / ファイル ライセンス アクション
KJ00001330486.pdf KJ00001330486.pdf (172.2 kB)
Item type National Convention(1)
公開日 1986-10-01
タイトル
タイトル MOS論理回路のタイミングシミュレーションの一方法
タイトル
言語 en
タイトル A Timming Simulation method of MOS Logical Circuits
言語
言語 jpn
資源タイプ
資源タイプ識別子 http://purl.org/coar/resource_type/c_5794
資源タイプ conference paper
著者所属
防衛大学校
著者所属
防衛大学校
著者所属(英)
en
National Defense Academy
著者所属(英)
en
National Defense Academy
論文抄録
内容記述タイプ Other
内容記述 MOS論理回路の論理検証のツールとしてスイッチレベルシミュレータが注目されている。スイッチレベルシミュレーションは、MOSトランジスタをスイッチとして扱い論理を検証する方法である。スイッチレベルシミュレーションでは、MOS論理回路をスイッチが結合したスイッチネットワークとして扱いシミュレーションを行うために論理値やMOSトランジスタに強さを与えこの強さによってスイッチネットワークの論理を決定する方法が多く用いられている。このような中において論理値等に強さを与えず各MOSトランジスタ等を3ステートイベント法と呼ばれる方法によってイベントを管理し、これによってシミュレートする方法も提案されている。ここでは、3ステートイベント法によるシミュレーション方法において遅延を考慮したタイミングシミュレーションの方法について提案を行いこれを実現するためのシミュレータの構成法について述べる。この方法によれば簡単なタイムホイールでシミュレーション時間の制御が行えることも示す。
書誌レコードID
収録物識別子タイプ NCID
収録物識別子 AN00349328
書誌情報 全国大会講演論文集

巻 第33回, 号 情報システム, p. 2161-2162, 発行日 1986-10-01
出版者
言語 ja
出版者 情報処理学会
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Ver.1 2025-01-21 06:22:42.363354
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