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アイテム
高エネルギー効率ルータ・バイパス法(EERB)による省電力NoC
https://ipsj.ixsq.nii.ac.jp/records/102262
https://ipsj.ixsq.nii.ac.jp/records/102262119ecda3-256d-462c-a572-a596407dfc6e
名前 / ファイル | ライセンス | アクション |
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![]() |
Copyright (c) 2014 by the Information Processing Society of Japan
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オープンアクセス |
Item type | SIG Technical Reports(1) | |||||||
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公開日 | 2014-07-21 | |||||||
タイトル | ||||||||
タイトル | 高エネルギー効率ルータ・バイパス法(EERB)による省電力NoC | |||||||
言語 | ||||||||
言語 | jpn | |||||||
キーワード | ||||||||
主題Scheme | Other | |||||||
主題 | 省電力とダークシリコン | |||||||
資源タイプ | ||||||||
資源タイプ識別子 | http://purl.org/coar/resource_type/c_18gh | |||||||
資源タイプ | technical report | |||||||
著者所属 | ||||||||
東京大学 | ||||||||
著者所属 | ||||||||
東京大学 | ||||||||
著者名 |
成子貴洋
平木敬
× 成子貴洋 平木敬
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論文抄録 | ||||||||
内容記述タイプ | Other | |||||||
内容記述 | チップあたりのコア数が増加するのに伴ない,近年では従来のバスに代わり,コア間の通信基盤としてチップ上のインターコネクション・ネットワークである Network-on-Chip(NoC) を用いるのが一般的になっている.NoC はバスと比べ高いスループットを提供できるものの,コア数が大きくなるに伴いネットワークのサイズも大きくなるため,チップ全体の性能や消費電力に及ぼす影響も大きなものとなっている.NoC の性能を改善する一つの方法として,ルータのバイパスが提案されている.これは,パケットの中間ルータの非同期的な通過を可能にすることにより,ネットワークのレイテンシを削減する手法である.一方で,既存のルータ・バイパス法では消費電力の削減はほぼ得られないことが分かっている.そこで本研究では,高エネルギー効率ルータ・バイパス法 (EERB) を提案し,ルータ・バイパス法を性能改善だけでなく,消費電力の削減にも活用することを目指す.シミュレーションにより,EERB を用いることで,低レイテンシと低消費電力を同時に実現できることが示された | |||||||
書誌レコードID | ||||||||
収録物識別子タイプ | NCID | |||||||
収録物識別子 | AN10096105 | |||||||
書誌情報 |
研究報告計算機アーキテクチャ(ARC) 巻 2014-ARC-211, 号 3, p. 1-6, 発行日 2014-07-21 |
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Notice | ||||||||
SIG Technical Reports are nonrefereed and hence may later appear in any journals, conferences, symposia, etc. | ||||||||
出版者 | ||||||||
言語 | ja | |||||||
出版者 | 情報処理学会 |