2026-06-07T07:29:19Z https://ipsj.ixsq.nii.ac.jp/oai

oai:ipsj.ixsq.nii.ac.jp:00212618 2025-01-19T17:26:35Z 6164:6165:7651:10646

間欠動作を行うIoT向けプロセッサに適したFiCCを用いた不揮発スタンダードセルメモリの実測評価 Nonvolatile Standard Cell Memory Using FiCC for IoT Processors with Intermittent Operations 阿部, 佑貴 小林, 和淑 塩見, 準 越智, 裕之 Yuki, Abe Kazutoshi, Kobayashi Jun, Shiomi Hiroyuki, Ochi 低電力・低エネルギー設計 スタンダードセルを用いて論理合成と自動配置配線により設計するメモリをスタンダードセルメモリ (SCM) と呼ぶ．本稿では，間欠動作を行う IoT 向けプロセッサに適した FiCC (Fishbone-in-Cage Capacitor) を用いた不揮発スタンダードセルメモリ (NV-SCM) の実測について述べる．180nm プロセスを用いて，NV-SCM のレイアウト設計を行った．ビットセルの不揮発化による面積オーバーヘッドは 75% となった．実測により，動作周波数 10MHz における NV-SCM の動作を確認した．データ保持時間は不揮発メモリへの書き込み時間を 0.5 秒とした場合，約 60 分となった．また，1 時間の内，5 分の動作を仮定すると，NV-SCM は SCM と比べ，消費エネルギーを 35.2% 削減できることをシミュレーションにより示す．さらに不揮発プロセッサの設計に向けて，NV-SCM 用ビットセルの修正に加え，不揮発プロセッサ用フリップフロップを提案した． A standard cell memory (SCM) is a memory designed by logic synthesis and automatic placement and routing using standard cells. In this paper, we show the measurement results of a nonvolatile standard cell memory (NV-SCM) using a Fishbone-in-Cage Capacitor (FiCC), which is suitable for IoT processors with intermittent operations. The NV-SCM was fabricated in a 180nm CMOS process technology. The area overhead due to the nonvolatility of bit cells was 75%. In measurements, we confirmed the operation of the NV-SCM at an operating frequency of 10MHz. The data retention time was about 60 minutes when the writing time to the nonvolatile memory was 0.5 seconds. Assuming 5 minutes operation time per hour, the simulation results show that the NV-SCM can reduce 35.2% of energy consumption compared to the SCM. In addition, for the design of a nonvolatile processor, we modified a bit cell for NV-SCM and proposed a flip-flop for the nonvolatile processor. 情報処理学会 2021-08-25 jpn conference paper https://ipsj.ixsq.nii.ac.jp/records/212618 DAシンポジウム2021論文集 2021 3 8 https://ipsj.ixsq.nii.ac.jp/record/212618/files/IPSJ-DAS2021003.pdf application/pdf 1.8 MB 2023-08-25