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アイテム
PGAS言語XcalableMPのメニーコアプロセッサクラスタ向け実行モデルの検討
https://ipsj.ixsq.nii.ac.jp/records/94648
https://ipsj.ixsq.nii.ac.jp/records/946488f0aa080-59bc-4578-8cc2-29593cb6641e
| 名前 / ファイル | ライセンス | アクション |
|---|---|---|
IPSJ-HPC13140036.pdf (1.7 MB)
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Copyright (c) 2013 by the Information Processing Society of Japan
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| オープンアクセス | ||
| Item type | SIG Technical Reports(1) | |||||||
|---|---|---|---|---|---|---|---|---|
| 公開日 | 2013-07-24 | |||||||
| タイトル | ||||||||
| タイトル | PGAS言語XcalableMPのメニーコアプロセッサクラスタ向け実行モデルの検討 | |||||||
| 言語 | ||||||||
| 言語 | jpn | |||||||
| キーワード | ||||||||
| 主題Scheme | Other | |||||||
| 主題 | GPU・メニーコアコンピューティング | |||||||
| 資源タイプ | ||||||||
| 資源タイプ識別子 | http://purl.org/coar/resource_type/c_18gh | |||||||
| 資源タイプ | technical report | |||||||
| 著者所属 | ||||||||
| インテル株式会社／筑波大学 | ||||||||
| 著者所属 | ||||||||
| 筑波大学 | ||||||||
| 著者所属(英) | ||||||||
| en | ||||||||
| Intel K.K. / University of Tsukuba | ||||||||
| 著者所属(英) | ||||||||
| en | ||||||||
| University of Tsukuba | ||||||||
| 著者名 |
池井満
× 池井満
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| 論文抄録 | ||||||||
| 内容記述タイプ | Other | |||||||
| 内容記述 | 我々は PGAS 言語 XMP の、メニーコアプロセッサ・クラスタ向けの実装の検討を行っている。対象のメニーコアプロセッサ・クラスタは、Intel Xeon サーバにメニーコアプロセッサ Xeon Phi のカードを搭載した計算ノード複数を、スイッチ接続したものである。このようなクラスタでプログラムを実行するには、共有メモリを持つ、Phi 単体内の 60+ コアでプログラムを実行する際の並列性と、物理的に独立したメモリ空間を持つ、複数ノードの Phi 間でプログラムを実行する際の並列性の、2 種類の並列性を同時に生かす必要がある。本発表では、XMP でのプログラミングモデルの性質を利用して、このような 2 階層の並列性を有効に実現するために、そのプログラム実行モデルの検討を行った。 | |||||||
| 書誌レコードID | ||||||||
| 収録物識別子タイプ | NCID | |||||||
| 収録物識別子 | AN10463942 | |||||||
| 書誌情報 |
研究報告ハイパフォーマンスコンピューティング（HPC） 巻 2013-HPC-140, 号 36, p. 1-8, 発行日 2013-07-24 |
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| Notice | ||||||||
| SIG Technical Reports are nonrefereed and hence may later appear in any journals, conferences, symposia, etc. | ||||||||
| 出版者 | ||||||||
| 言語 | ja | |||||||
| 出版者 | 情報処理学会 | |||||||
