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スーパーコンピュータ「京」におけるアプリケーション性能へのTLBの影響
https://ipsj.ixsq.nii.ac.jp/records/87871
https://ipsj.ixsq.nii.ac.jp/records/878718db2522a-7f09-444b-993c-43d6d243ca6a
| 名前 / ファイル | ライセンス | アクション |
|---|---|---|
IPSJ-HPCS2013043.pdf (1.4 MB)
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Copyright (c) 2013 by the Information Processing Society of Japan
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| オープンアクセス | ||
| Item type | Symposium(1) | |||||||
|---|---|---|---|---|---|---|---|---|
| 公開日 | 2013-01-08 | |||||||
| タイトル | ||||||||
| タイトル | スーパーコンピュータ「京」におけるアプリケーション性能へのTLBの影響 | |||||||
| タイトル | ||||||||
| 言語 | en | |||||||
| タイトル | Performance Impact of TLB on the K computer Applications | |||||||
| 言語 | ||||||||
| 言語 | jpn | |||||||
| キーワード | ||||||||
| 主題Scheme | Other | |||||||
| 主題 | 最適化 | |||||||
| 資源タイプ | ||||||||
| 資源タイプ識別子 | http://purl.org/coar/resource_type/c_5794 | |||||||
| 資源タイプ | conference paper | |||||||
| 著者所属 | ||||||||
| 理化学研究所 | ||||||||
| 著者所属 | ||||||||
| 富士通株式会社 | ||||||||
| 著者所属 | ||||||||
| 富士通株式会社 | ||||||||
| 著者所属 | ||||||||
| 理化学研究所 | ||||||||
| 著者所属 | ||||||||
| 理化学研究所 | ||||||||
| 著者所属 | ||||||||
| 理化学研究所 | ||||||||
| 著者所属 | ||||||||
| 理化学研究所 | ||||||||
| 著者所属(英) | ||||||||
| en | ||||||||
| RIKEN | ||||||||
| 著者所属(英) | ||||||||
| en | ||||||||
| FUJITSU, LTD. | ||||||||
| 著者所属(英) | ||||||||
| en | ||||||||
| FUJITSU, LTD. | ||||||||
| 著者所属(英) | ||||||||
| en | ||||||||
| RIKEN | ||||||||
| 著者所属(英) | ||||||||
| en | ||||||||
| RIKEN | ||||||||
| 著者所属(英) | ||||||||
| en | ||||||||
| RIKEN | ||||||||
| 著者所属(英) | ||||||||
| en | ||||||||
| RIKEN | ||||||||
| 著者名 |
黒田, 明義
× 黒田, 明義
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| 著者名(英) |
Akiyoshi, Kuroda
× Akiyoshi, Kuroda
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| 論文抄録 | ||||||||
| 内容記述タイプ | Other | |||||||
| 内容記述 | ハイパフォーマンスコンピューティングにおけるアプリケーション性能は，アルゴリズムやシステム特性など様々な要因によって変化する．このためハードウェアの性能を最大限に引き出すためには，ハードウェア，システムソフトウェア，アプリケーション開発者の連携が重要となる．今回，TLBがアプリケーション性能に及ぼす影響について，スーパーコンピュータ「京」上で，いくつかのアプリケーションを用いて解析を行ったので報告する．TLBとは仮想アドレスと物理アドレスの変換を行う機構であるが，どのようなアーキテクチャであれ，キャッシュ同様そのデータアクセスパターンによってアプリケーション性能への影響が予測される．しかし，いつどこでTLBミス発生するか予測が困難であることから，単純な性能低下ではなく，想定される箇所以外の性能のばらつきとして計測されることが多い．本報では，TLBミスによって引き起こされる性能への影響について，その原因，特徴，並びに解決方法について，いくつかのアプリケーションの実測結果を元に議論する． | |||||||
| 論文抄録(英) | ||||||||
| 内容記述タイプ | Other | |||||||
| 内容記述 | Application performance in high-performance computing depends on various factors such as algorithms and systems. To maximize hardware performance, it is important for collaboration among hardware, system software, and application developers. We report the performance impact of TLB on the application by simultaneously running several applications on the K computer. TLB is a mechanism that translates virtual and physical addresses in any architecture. Performance impact of TLB on the application is predicted by the data access pattern, which is similar to that of the cache. It is difficult to analyze when and where a TLB miss may occur, because it is often measured not only as performance degradation but also as performance fluctuation. In this paper, we discuss not only calculation results based on some applications that measure the performance impact by TLB misses but also their causes and characteristics, as well as some ways to resolve them. | |||||||
| 書誌情報 |
ハイパフォーマンスコンピューティングと計算科学シンポジウム論文集 巻 2013, p. 104-112, 発行日 2013-01-08 |
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| 出版者 | ||||||||
| 言語 | ja | |||||||
| 出版者 | 情報処理学会 | |||||||
