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アイテム
ブロック反復法による電源回路網解析の高速化
https://ipsj.ixsq.nii.ac.jp/records/79467
https://ipsj.ixsq.nii.ac.jp/records/7946723fade3a-6651-4fb5-9ceb-632ecf46b07d
| 名前 / ファイル | ライセンス | アクション |
|---|---|---|
IPSJ-SLDM11153012.pdf (439.9 kB)
2100年1月1日からダウンロード可能です。
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Copyright (c) 2011 by the Institute of Electronics, Information and Communication Engineers
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| SLDM:会員：¥0, DLIB:会員：¥0 | ||
| Item type | SIG Technical Reports(1) | |||||||
|---|---|---|---|---|---|---|---|---|
| 公開日 | 2011-11-21 | |||||||
| タイトル | ||||||||
| タイトル | ブロック反復法による電源回路網解析の高速化 | |||||||
| タイトル | ||||||||
| 言語 | en | |||||||
| タイトル | An Acceleration Method for Power Grid Analysis using Block-Iterative Algorithm | |||||||
| 言語 | ||||||||
| 言語 | jpn | |||||||
| キーワード | ||||||||
| 主題Scheme | Other | |||||||
| 主題 | 配置配線 | |||||||
| 資源タイプ | ||||||||
| 資源タイプ識別子 | http://purl.org/coar/resource_type/c_18gh | |||||||
| 資源タイプ | technical report | |||||||
| 著者所属 | ||||||||
| 京都大学大学院情報学研究科 | ||||||||
| 著者所属 | ||||||||
| 京都大学大学院情報学研究科 | ||||||||
| 著者所属 | ||||||||
| 京都大学大学院情報学研究科 | ||||||||
| 著者所属 | ||||||||
| 京都大学大学院情報学研究科 | ||||||||
| 著者所属(英) | ||||||||
| en | ||||||||
| Graduate School of Informatics, Kyoto University | ||||||||
| 著者所属(英) | ||||||||
| en | ||||||||
| Graduate School of Informatics, Kyoto University | ||||||||
| 著者所属(英) | ||||||||
| en | ||||||||
| Graduate School of Informatics, Kyoto University | ||||||||
| 著者所属(英) | ||||||||
| en | ||||||||
| Graduate School of Informatics, Kyoto University | ||||||||
| 著者名 |
森下, 拓海
× 森下, 拓海
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| 著者名(英) |
Takumi, Morishita
× Takumi, Morishita
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| 論文抄録 | ||||||||
| 内容記述タイプ | Other | |||||||
| 内容記述 | 半導体プロセスの微細化が進み，電源回路網の解析が重要になっている．また，電源回路網それ自体の規模も大きく，今後のさらなる巨大化に対応するためにも，回路解析の高速化省メモリ化が大きな課題となっている．ブロック反復法は直接法と反復法を組み合わせた解析方法であり，大規模電源回路網解析への応用が期待されている．本稿ではブロック反復法の高速化を目的として，SOR 法およびブロック分割の観点から収束の加速方法を検討する． | |||||||
| 論文抄録(英) | ||||||||
| 内容記述タイプ | Other | |||||||
| 内容記述 | Because of its extremely large size, power grid analysis has been a computationally challenging problem both in terms of runtime and memory usage. LU factorization has been widely used to analyze voltage drop simulations due to its stability, but contiguous technology scaling demands even more efficient calculation methods. In this paper, application of block-iterative method, which combines LU factorization and iterative method, is proposed for efficient analysis of power grid analysis. Automatic adjustment of relaxation factor in successive over-relaxation method and block decomposition algorithm are proposed. Evaluation results are also presented. | |||||||
| 書誌レコードID | ||||||||
| 収録物識別子タイプ | NCID | |||||||
| 収録物識別子 | AA11451459 | |||||||
| 書誌情報 |
研究報告システムLSI設計技術（SLDM） 巻 2011-SLDM-153, 号 12, p. 1-5, 発行日 2011-11-21 |
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| Notice | ||||||||
| SIG Technical Reports are nonrefereed and hence may later appear in any journals, conferences, symposia, etc. | ||||||||
| 出版者 | ||||||||
| 言語 | ja | |||||||
| 出版者 | 情報処理学会 | |||||||
