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NASPB CG，FTにおけるSCIMAの性能評価
https://ipsj.ixsq.nii.ac.jp/records/29430
https://ipsj.ixsq.nii.ac.jp/records/29430127004e2-c702-40fe-b935-9652702f6cff
| 名前 / ファイル | ライセンス | アクション |
|---|---|---|
IPSJ-HPC00083006.pdf (713.6 kB)
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Copyright (c) 2000 by the Information Processing Society of Japan
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| オープンアクセス | ||
| Item type | SIG Technical Reports(1) | |||||||
|---|---|---|---|---|---|---|---|---|
| 公開日 | 2000-10-06 | |||||||
| タイトル | ||||||||
| タイトル | NASPB CG，FTにおけるSCIMAの性能評価 | |||||||
| タイトル | ||||||||
| 言語 | en | |||||||
| タイトル | Performance evaluation of SCIMA for NASPB Kernel CG, FT | |||||||
| 言語 | ||||||||
| 言語 | jpn | |||||||
| 資源タイプ | ||||||||
| 資源タイプ識別子 | http://purl.org/coar/resource_type/c_18gh | |||||||
| 資源タイプ | technical report | |||||||
| 著者所属 | ||||||||
| 東京大学先端科学技術研究センター | ||||||||
| 著者所属 | ||||||||
| 東京大学先端科学技術研究センター | ||||||||
| 著者所属 | ||||||||
| 東京大学先端科学技術研究センター | ||||||||
| 著者所属 | ||||||||
| 東京大学先端科学技術研究センター | ||||||||
| 著者所属 | ||||||||
| 筑波大学電子・情報工学系 | ||||||||
| 著者所属(英) | ||||||||
| en | ||||||||
| Research Center for Advanced science and Technology, The University of Tokyo | ||||||||
| 著者所属(英) | ||||||||
| en | ||||||||
| Research Center for Advanced science and Technology, The University of Tokyo | ||||||||
| 著者所属(英) | ||||||||
| en | ||||||||
| Research Center for Advanced science and Technology, The University of Tokyo | ||||||||
| 著者所属(英) | ||||||||
| en | ||||||||
| Research Center for Advanced science and Technology, The University of Tokyo | ||||||||
| 著者所属(英) | ||||||||
| en | ||||||||
| Institute of Information Science and Electronics, University of Tsukuba | ||||||||
| 著者名 |
岩本, 貢
× 岩本, 貢
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| 著者名(英) |
Mitsugu, Iwamoto
× Mitsugu, Iwamoto
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| 論文抄録 | ||||||||
| 内容記述タイプ | Other | |||||||
| 内容記述 | 大規模な科学技術計算において従来のメモリアーキテクチャは有効ではなく，オフチップメモリへのアクセスが頻発するような場合に計算速度は大きく低下する．そこでチップ上のデータを有効利用することが重要になる．ところが，従来用いられるキャッシュアーキテクチャはいくつかの問題点がある．そこで，キャッシュの一部をアドレス指定可能なメモリとして用いることで，ユーザによるチップ上でのデータの制御が可能なオンチップメモリ記憶を実装するプロセッサアーキテクチャSCIMAが提案されている．本稿では、Nas Parallel BenchmarksのCG，FTを例にとりSCIMAアーキテクチャが従来のキャッシュアーキテクチャより有効であることをシミュレーションを用いて示す． | |||||||
| 論文抄録(英) | ||||||||
| 内容記述タイプ | Other | |||||||
| 内容記述 | The performance gap between processor and memory will be growing in the near future. This is a serious problem especially in high performance computing. In order to overcome this problem, we have presented the new VLSI architecture called SCIMA. SCIMA has more effective data management ability than the conventional cache-based architecture, because data replacement and the data allocation of on-chip memory can be controlled by software. In this paper, we show the effectiveness of SCIMA compared to the cache-based architecture with the clock level simulator for the Nas parallel Benchmarks CG, FT as examples. | |||||||
| 書誌レコードID | ||||||||
| 収録物識別子タイプ | NCID | |||||||
| 収録物識別子 | AN10463942 | |||||||
| 書誌情報 |
情報処理学会研究報告ハイパフォーマンスコンピューティング（HPC） 巻 2000, 号 93(2000-HPC-083), p. 31-36, 発行日 2000-10-06 |
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| Notice | ||||||||
| SIG Technical Reports are nonrefereed and hence may later appear in any journals, conferences, symposia, etc. | ||||||||
| 出版者 | ||||||||
| 言語 | ja | |||||||
| 出版者 | 情報処理学会 | |||||||
