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アイテム
信頼性と性能のトレードオフ評価指標の提案とそのマルチコアプロセッサへの適用
https://ipsj.ixsq.nii.ac.jp/records/28706
https://ipsj.ixsq.nii.ac.jp/records/287061906bf9a-a197-4b91-b447-5250da39d2b0
| 名前 / ファイル | ライセンス | アクション |
|---|---|---|
IPSJ-HPC08114009.pdf (673.5 kB)
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Copyright (c) 2008 by the Information Processing Society of Japan
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| オープンアクセス | ||
| Item type | SIG Technical Reports(1) | |||||||
|---|---|---|---|---|---|---|---|---|
| 公開日 | 2008-03-05 | |||||||
| タイトル | ||||||||
| タイトル | 信頼性と性能のトレードオフ評価指標の提案とそのマルチコアプロセッサへの適用 | |||||||
| タイトル | ||||||||
| 言語 | en | |||||||
| タイトル | A Metric for the Dependability-Performance Trade-off and its Application to a Multcore Processor | |||||||
| 言語 | ||||||||
| 言語 | jpn | |||||||
| 資源タイプ | ||||||||
| 資源タイプ識別子 | http://purl.org/coar/resource_type/c_18gh | |||||||
| 資源タイプ | technical report | |||||||
| 著者所属 | ||||||||
| 九州工業大学大学院情報科学研究科 | ||||||||
| 著者所属 | ||||||||
| 九州大学システムLSI研究センター／独立行政法人科学技術振興機構，CREST | ||||||||
| 著者所属(英) | ||||||||
| en | ||||||||
| Graduate School of Computer Science and System Engineering, Kyushu Institute of Technology | ||||||||
| 著者所属(英) | ||||||||
| en | ||||||||
| System LSI Research Center, Kyushu University / Japan Science and Technology Agency, CREST | ||||||||
| 著者名 |
舟木, 敏正
× 舟木, 敏正
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| 著者名(英) |
Toshimasa, Funaki
× Toshimasa, Funaki
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| 論文抄録 | ||||||||
| 内容記述タイプ | Other | |||||||
| 内容記述 | 近年，性能と消費電力だけでなく信頼性もプロセッサに要求されている．これらはお互いにトレードオフの関係にあるので，プロセッサの評価のために新たな指標が必要である．その最初の段階として，本稿では性能と信頼性のトレードオフ指標を提案する．この指標を我々が現在検討中のマルチ・クラスタ型コア・プロセッサ(MCCP:Multiple Clustered Core Processsor) に適用する．MCCP は性能・消費電力・信頼性のトレードオフを考慮してその構成を変更し，冗長実行モードを選択する．したがって，各実行モードの性能・電力・信頼性の評価指標が必要となる．提案指標を用いることで，命令冗長実行では性能低下に見合った信頼性が確保できないことが判明した． | |||||||
| 論文抄録(英) | ||||||||
| 内容記述タイプ | Other | |||||||
| 内容記述 | Modern microprocessors require dependability as well as high-performance and power efficiency. Since there are trade-offs between them, a new metric considering the trade-offs to evaluate microprocessors. This paper proposes a metric for the dependability-performance trade-off as a first step toward considering the 3-dimensional (3D) trade-off. Using the metric, this paper evaluates Multiple Clustered Core Processor (MCCP) that is under investigation. We consider the 3D trade-off on the MCCP by selecting an appropriate processor configuration and a redundancy mode. We find that the MCCP diminishes both performance and dependability in the instruction-level redundancy mode. | |||||||
| 書誌レコードID | ||||||||
| 収録物識別子タイプ | NCID | |||||||
| 収録物識別子 | AN10463942 | |||||||
| 書誌情報 |
情報処理学会研究報告ハイパフォーマンスコンピューティング（HPC） 巻 2008, 号 19(2008-HPC-114), p. 49-54, 発行日 2008-03-05 |
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| Notice | ||||||||
| SIG Technical Reports are nonrefereed and hence may later appear in any journals, conferences, symposia, etc. | ||||||||
| 出版者 | ||||||||
| 言語 | ja | |||||||
| 出版者 | 情報処理学会 | |||||||
