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アイテム
DRPでのウェーブレットフィルタの実装
https://ipsj.ixsq.nii.ac.jp/records/27468
https://ipsj.ixsq.nii.ac.jp/records/27468da6e1eb4-174d-4293-99db-69f219b44827
| 名前 / ファイル | ライセンス | アクション |
|---|---|---|
IPSJ-SLDM02108023.pdf (1.3 MB)
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Copyright (c) 2003 by the Information Processing Society of Japan
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| オープンアクセス | ||
| Item type | SIG Technical Reports(1) | |||||||
|---|---|---|---|---|---|---|---|---|
| 公開日 | 2003-01-28 | |||||||
| タイトル | ||||||||
| タイトル | DRPでのウェーブレットフィルタの実装 | |||||||
| タイトル | ||||||||
| 言語 | en | |||||||
| タイトル | Implementation of Discrete Wavelet Transform on DRP | |||||||
| 言語 | ||||||||
| 言語 | jpn | |||||||
| 資源タイプ | ||||||||
| 資源タイプ識別子 | http://purl.org/coar/resource_type/c_18gh | |||||||
| 資源タイプ | technical report | |||||||
| 著者所属 | ||||||||
| 慶応義塾大学大学院理工学研究科 | ||||||||
| 著者所属 | ||||||||
| 慶応義塾大学大学院理工学研究科 | ||||||||
| 著者所属 | ||||||||
| 慶応義塾大学大学院理工学研究科 | ||||||||
| 著者所属(英) | ||||||||
| en | ||||||||
| Graduate School of Science and Technology, Keio University | ||||||||
| 著者所属(英) | ||||||||
| en | ||||||||
| Graduate School of Science and Technology, Keio University | ||||||||
| 著者所属(英) | ||||||||
| en | ||||||||
| Graduate School of Science and Technology, Keio University | ||||||||
| 著者名 |
出口, 勝昭
× 出口, 勝昭
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| 著者名(英) |
Katsuaki, Deguchi
× Katsuaki, Deguchi
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| 論文抄録 | ||||||||
| 内容記述タイプ | Other | |||||||
| 内容記述 | NECが開発したDynamically Reconfigurable Processor(DRP)は、Processing Element(PE)の配列から成るTileの集合によりデータパスを形成する。DRPは16コンテキスト分をチップ内に保持し、これをTile単位で自由に切り替えることが可能である。このDRPのマルチコンテキスト機能を利用して、複数の基底数を扱うことが可能なDaubechiesのウェーブレットフィルタを実装した設計事例について報告する。DRP上に実装した基底可変フィルタは、基底数固定フィルタの性能に比べると若干性能が低いが、最新のPC上にソフトウェアによる実行性能に匹敵する性能を実現可能であることがわかった。 | |||||||
| 論文抄録(英) | ||||||||
| 内容記述タイプ | Other | |||||||
| 内容記述 | NEC's Dynamically Reconfigurable Processor (DRP) is a multicontext reconfigurable device consisting of eight individually reconfigurable units called "Tile." Data path configuration mapped to each tile can be selected from on-chip repository of sixteen circuit configurations, or contexts. The context switching can be done with a clock cycle. Using this mechanism, Daubechies wavelet filter whose length of filter can be changed is designed and implemented. Evaluation results show that the performance degradation caused by the variable length mechanism is not so large compared with a fixed length filter, and its absolute performance is comparable to those of software execution on recent high performance PCs. | |||||||
| 書誌レコードID | ||||||||
| 収録物識別子タイプ | NCID | |||||||
| 収録物識別子 | AA11451459 | |||||||
| 書誌情報 |
情報処理学会研究報告システムLSI設計技術（SLDM） 巻 2003, 号 7(2002-SLDM-108), p. 129-134, 発行日 2003-01-28 |
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| Notice | ||||||||
| SIG Technical Reports are nonrefereed and hence may later appear in any journals, conferences, symposia, etc. | ||||||||
| 出版者 | ||||||||
| 言語 | ja | |||||||
| 出版者 | 情報処理学会 | |||||||
