WEKO3
アイテム
小規模・省電力コアのための省資源分岐予測方式
https://ipsj.ixsq.nii.ac.jp/records/22955
https://ipsj.ixsq.nii.ac.jp/records/2295505e2fff0-6939-47e2-90c6-533c0f784a19
名前 / ファイル | ライセンス | アクション |
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![]() |
Copyright (c) 2007 by the Information Processing Society of Japan
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オープンアクセス |
Item type | SIG Technical Reports(1) | |||||||
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公開日 | 2007-08-03 | |||||||
タイトル | ||||||||
タイトル | 小規模・省電力コアのための省資源分岐予測方式 | |||||||
タイトル | ||||||||
言語 | en | |||||||
タイトル | Complextiy-Effective Branch Prediction for Area & Power Efficient Processor | |||||||
言語 | ||||||||
言語 | jpn | |||||||
資源タイプ | ||||||||
資源タイプ識別子 | http://purl.org/coar/resource_type/c_18gh | |||||||
資源タイプ | technical report | |||||||
著者所属 | ||||||||
日本電気株式会社 コンピュータ事業部 | ||||||||
著者所属 | ||||||||
東京大学情報理工学系研究科 | ||||||||
著者所属(英) | ||||||||
en | ||||||||
Computers Division, NEC Corporation | ||||||||
著者所属(英) | ||||||||
en | ||||||||
Graduate School of Information Science and Technology, the University of Tokyo | ||||||||
著者名 |
石井, 康雄
× 石井, 康雄
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著者名(英) |
Yasuo, Ishii
× Yasuo, Ishii
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論文抄録 | ||||||||
内容記述タイプ | Other | |||||||
内容記述 | 本稿では 実装時の遅延と回路規模を考慮した分岐予測器である MIN-TAGE 分岐予測器を提案する.この手法ではパターン履歴テーブルのインデックス計算を Enhanced Folded Index 手法を利用して計算することにより 既存手法と比較して分岐予測にかかる遅延とパイプライン化に伴うコストを削減する.このインデックス計算により効率的な分岐予測器のパイプライン化を実現する. MIN-TAGE 分岐予測器を 2nd Championship Branch Prediction Infrastructure で評価した.その結果 MIN-TAGE 分岐予測器は TAGE 分岐予測器から構成コストを削減した上で 分岐予測ミスを2.6%削減した. | |||||||
論文抄録(英) | ||||||||
内容記述タイプ | Other | |||||||
内容記述 | In this paper, we propose MIN-TAGE branch predictor which realizes a complexity-effective implementation and a feasible prediction latency. MIN-TAGE branch predictor employs enhanced folded indexing registers as hash function. The enhanced folded index reduces prediction latency from conventional branch predictors and saves external costs for ahead pipelining. This feature realizes an effective ahead pipelining structure. We evaluate MIN-TABE branch predictor in 2nd Championship Branch Prediction Infrastructure. MIN-TAGE branch predictor reduces miss predictions per 1000 instructions by 2.6% and saves implementation costs from a costly conventional ahead pipelined TAGE branch predictor. | |||||||
書誌レコードID | ||||||||
収録物識別子タイプ | NCID | |||||||
収録物識別子 | AN10096105 | |||||||
書誌情報 |
情報処理学会研究報告計算機アーキテクチャ(ARC) 巻 2007, 号 79(2007-ARC-174), p. 205-210, 発行日 2007-08-03 |
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Notice | ||||||||
SIG Technical Reports are nonrefereed and hence may later appear in any journals, conferences, symposia, etc. | ||||||||
出版者 | ||||||||
言語 | ja | |||||||
出版者 | 情報処理学会 |