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  1. 論文誌(ジャーナル)
  2. Vol.34
  3. No.5

SSS (Simple Serial Synchronized)型マルチステージネットワーク

https://ipsj.ixsq.nii.ac.jp/records/14493
https://ipsj.ixsq.nii.ac.jp/records/14493
e0285db3-3fbc-4a73-af93-7532c75a5edc
名前 / ファイル ライセンス アクション
IPSJ-JNL3405032.pdf IPSJ-JNL3405032.pdf (1.1 MB)
Copyright (c) 1993 by the Information Processing Society of Japan
オープンアクセス
Item type Journal(1)
公開日 1993-05-15
タイトル
タイトル SSS (Simple Serial Synchronized)型マルチステージネットワーク
タイトル
言語 en
タイトル Simple Serial Synchronized Multi - stage Interconnection Network
言語
言語 jpn
キーワード
主題Scheme Other
主題 論文
資源タイプ
資源タイプ識別子 http://purl.org/coar/resource_type/c_6501
資源タイプ journal article
その他タイトル
その他のタイトル ハードウェア
著者所属
慶應義塾大学理工学部
著者所属
慶應義塾大学理工学部
著者所属
日立製作所マイクロエレクトロニクス機器開発研究所
著者所属(英)
en
Faculty of Science and Technology, Keio University
著者所属(英)
en
Faculty of Science and Technology, Keio University
著者所属(英)
en
Microelectronics Products Development Laboratory, Hitachi, Ltd
著者名 天野, 英晴 周洛 藤川, 義文

× 天野, 英晴 周洛 藤川, 義文

天野, 英晴
周洛
藤川, 義文

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著者名(英) Hideharu, Amano Luo, Zhou Yoshifumi, Fujikawa

× Hideharu, Amano Luo, Zhou Yoshifumi, Fujikawa

en Hideharu, Amano
Luo, Zhou
Yoshifumi, Fujikawa

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論文抄録
内容記述タイプ Other
内容記述 Multistage Intercomection Network(MIN)は、大規模マルチプロセッサにおけるプロセッサーメモリ間結合法として注目されてきた。しかし、従来マルチプロセッサ用に提案されてきたMINは、LSIチップのピン数制限と、構造および制御の複雑さにより、高密度実装が困難である。この問題点を解決するため、新しいクラスのMIN,SSS(Simple Serial Synchronized)型MINを提案し、評価する。SSS型MINは単純なエレメントからなる通過率の高いネットワークを用いて、ビットシリアルに入力されたパケットを同期式に交換する。エレメントの構造と制御が簡単であるため、従来型に比べ高速動作が可能であり、ビットシリアル転送を基本とするため、ピン数制限の問題が解決され高密度実装が可能である。シリアル転送を用いることによる性能低下は、パイプライン化サーキットスイッチング、ステージの飛び越し、ビットシリアルメッセージ結合等の性能強化法と、同一宛先の複数パケットの通過を許す結合網TBSF(Tandem Banyan Switching Fabrics)、PBSF(Pi1ed Banyan Switching Fabrics)の利用により補うことができる。この結果、SSS型MINは、約8分の1のチップ数で従来型のMINと同等もしくはこれを上回る性能を実現することが明らかになった。
書誌レコードID
収録物識別子タイプ NCID
収録物識別子 AN00116647
書誌情報 情報処理学会論文誌

巻 34, 号 5, p. 1134-1143, 発行日 1993-05-15
ISSN
収録物識別子タイプ ISSN
収録物識別子 1882-7764
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Ver.1 2025-01-23 00:47:58.493041
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