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アイテム
PIE64のネットワーク・インタフェス・プロセッサのシミュレーションによる性能評価
https://ipsj.ixsq.nii.ac.jp/records/118803
https://ipsj.ixsq.nii.ac.jp/records/118803615bfd7b-eac9-43b7-af19-310f4ff099d1
| 名前 / ファイル | ライセンス | アクション |
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KJ00001338423.pdf (147.9 kB)
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| Item type | National Convention(1) | |||||
|---|---|---|---|---|---|---|
| 公開日 | 1990-03-14 | |||||
| タイトル | ||||||
| タイトル | PIE64のネットワーク・インタフェス・プロセッサのシミュレーションによる性能評価 | |||||
| タイトル | ||||||
| 言語 | en | |||||
| タイトル | Performance Evaluation through simulations of the Network Interface Processor of PIE64 | |||||
| 言語 | ||||||
| 言語 | jpn | |||||
| 資源タイプ | ||||||
| 資源タイプ識別子 | http://purl.org/coar/resource_type/c_5794 | |||||
| 資源タイプ | conference paper | |||||
| 著者所属 | ||||||
| 東京大学 工学部 | ||||||
| 著者所属 | ||||||
| 東京大学 工学部 | ||||||
| 著者所属 | ||||||
| 東京大学 工学部 | ||||||
| 著者所属(英) | ||||||
| en | ||||||
| the University of Tokyo | ||||||
| 著者所属(英) | ||||||
| en | ||||||
| the University of Tokyo | ||||||
| 著者所属(英) | ||||||
| en | ||||||
| the University of Tokyo | ||||||
| 論文抄録 | ||||||
| 内容記述タイプ | Other | |||||
| 内容記述 | 現在、我々の研究室では、並列推論マシンPIE64の開発をすすめている。PIE64の64台の推論ユニット-IU(Inference Unit)-それぞれには、他のIUとの間で相互結合網を介して、データ交換、プロセス間同期、一括ガベージ・コレクション支援といった並列処理機能を支援する専用プロセッサとしてのネットワーク・インターフェース・プロセッサ-NIP(Net-work Interface Processor)-が置かれる。NIPは最大1クロック/1ワードのデータ転送、および、5クロック/1単位処理のプロセス間同期処理を行なえるように設計されているが、その実効性能は、PIE64のIU内のメモリ・バスへのアクセス権の獲得率に左右される。本稿では、メモリ・バスのアクセス権の獲得率がNIPのコマンド実行時間に与える影響をNIPのクロック・レベルのシミュレータによって評価した結果について報告する。 | |||||
| 書誌レコードID | ||||||
| 収録物識別子タイプ | NCID | |||||
| 収録物識別子 | AN00349328 | |||||
| 書誌情報 |
全国大会講演論文集 巻 第40回, 号 ハードウェア, p. 1173-1174, 発行日 1990-03-14 |
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| 出版者 | ||||||
| 言語 | ja | |||||
| 出版者 | 情報処理学会 | |||||
